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        研究天線電源故障檢測電路的設計

        作者: 時間:2011-10-27 來源:網絡 收藏
        CPLD邏輯電路

          圖6是CPLD內部邏輯電路,CPLD選用的是LATTICE公司的ispLSI1016E,邏輯設計采用原理圖輸入法,主要功能是對MUX的通道進行選擇、對A/D轉換器進行控制及產生自檢代碼等。圖中有三個主要器件:數據雙向開關、數據鎖存器、譯碼器。數據雙向開關的OE為低時,數據A0~A7傳向單片機的數據線D0~D7,該數據正常時是自檢代碼AAH,當OE為高時,單片機數據傳向CPLD內部的鎖存器,用來對多路模擬開關進行選擇。端口地址譯碼使用了單片機的RD、WR、P22、P23引腳,還使用了單片機的P20及P21引腳,它們分別連接到A/D轉換器CS和CE端,具體地址定義如下:


          CPLD自檢測地址:0x0700

          通道選擇數據鎖存器地址:0x0b00

          A/D轉換器寫地址:0x0c00

          A/D轉換器讀地址:0x0e00

          信號MUX1~MUX5是MUX電路的前級芯片選擇信號,高電平有效;DD0~DD2是MUX電路前級的通道選擇信號,取值范圍是0~34,對應模擬通道的1~35;DD5~DD7是MUX電路的后級通道選擇信號,取值范圍為0~4,分別對應前級的五個MUX的輸出信號。這些信號的產生過程是:單片機通過數據線D0~D7將通道選擇數據及芯片選擇數據送到鎖存器,產生通道選擇信號DD0~DD2及DD5~DD7,再將部分數據進行譯碼產生MUX的片選信號MUX1~MUX5。


                 圖6 CPLD邏輯電路

          結語

          目前該電路已經應用到某雷達中,隨雷達系統通過設計定型,進入批量生產階段,實踐證明,該檢測電路工作穩定可靠,能準確實時的對系統進行監測,率≥98%,故障隔離率≥95%,虛警率≤3%,達到設計要求。


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