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        基于SoPC的FPGA在線測試方法

        作者: 時間:2011-11-09 來源:網絡 收藏
        4 數據傳輸的NiosⅡ控制

          4.1 DMA控制器的操作

          Altera公司為DMA控制器提供了硬件抽象層(HAL)接口函數,使用這些函數編程需要注意的地方主要有2點:一是要考慮到Cache數據的一致性問題,在調用發送/接收函數之前需要調用相關函數清除數據Cache中的內容;另外一個需要注意的地方是DMA控制器的alt_dma_txchan _send()函數以及alt_dma_rxchan_prepare()函數的第3個參數表示的是請求DMA控制器發送/接收的字節數,而不是字或者雙字、四字數。

          4.2 Host-Base File System

          Altera公司提供的Host-Base File System組件可以使正在目標板上執行的程序讀/寫存儲在主機上的文件,文件的數據是NiosⅡIDE通過Altera下載線纜與目標板進行數據交互的。目標板上的程序可以使用ANSIC標準庫函數如fopen、fread等函數來進行文件的操作,用戶使用Host-Base File System前必須先在NtosII IDE工程中添加這個軟件組件,而且只能運行在Debug模式下。另外,對于上傳至PC的測試數據,也可以使用設置標準輸入/輸出信息存放于主機上的某個文件(在NiosⅡIDE/Run/Run…/Common下指定)而繞開Host-BaseFile System,但是對于主機文件數據下載給目標板的情況,對文件的操作必須添加這個組件。

          4.3 測試數據讀、寫控制

          當需要采集測試數據時,首先在FPGA內部用硬件語言編寫模塊把測試數據存入DMA讀從外設的FIFO,然后DMA讀從外設產生中斷請求,NiosⅡ接到中斷請求后,首先查看中斷產生的原因是FIFO寫滿還是數據包結束。若中斷原因是數據包結束,則NiosⅡ讀DMA讀從外設的usedw寄存器獲取FIFO已使用字數,并把這個值作為DMA控制器的傳輸長度發起DMA傳輸;若是FIFO寫滿,則發起固定長度(如FIFO深度)的DMA讀傳輸,DMA傳輸完畢后用ANSIC標準函數fwrite()把數據寫入PC機的數據文件。

          對于存儲在PC機上的數據激勵文件,NiosⅡIDE首先通過ANSIC標準函數fread()讀入NiosⅡ的數據存儲器,在查詢DMA寫從外設中FIFO未滿時,把數據寫入外部的FIFO,完成數據激勵文件的傳輸。

          5 系統驗證

          5.1 系統測試條件

          本次測試中FPGA芯片為Altera公司的CycloneIII EP3C120F484C8,系統時鐘為50 MHz,使用的JTAG傳輸線纜為USB Blaster,NiosⅡ為經濟模式,自定義DMA讀、寫外設內部FIFO均為2 K×16 b,NiosⅡ數據存儲器On-Chip RAM大小為60 KB,使用Host-Base File System組件,在NiosⅡ工程屬性中選中“Reduced device drivers”,經過NiosⅡIDE編譯后代碼占用程序存儲空間為50 KB。

          5.2 測試數據傳輸測試

          在FPGlA目標系統測試數據上傳至PC的測試中,在FPGA內部用verilog語言編寫了一個數據源模塊,數據源輸出為2~8 000的計數值,數據寬度為16位,在數據8 000輸出時,數據包結束信號有效,這樣既可以驗證FIFO滿中斷的情況又可以驗證數據包結束中斷的情況。測試數據源首、尾部的SignalTapⅡ測試波形如圖4所示。在NiosⅡIDE,通過把pritnf()函數輸出的調試信息自動存放到一個文本文件中,刪去首、尾的調試信息即得到有效數據文件。文本文件數據結果如圖5所示,其中數字后面的小黑塊代表換行符,從結果看,此方法實現了測試數據的正確上傳(注:由于測試數據太長,文中只給出數據的首部和尾部的截圖)。

          

          5.3 激勵數據傳輸測試

          在激勵數據傳輸測試時激勵數據為存儲于PC機上的計數值為1~2048二進制流文件,數據寬度為16位,通過加入Host-Base File System組件調用fopen()與fread()函數完成數據的讀出,當查詢DMA寫從設備未滿時發起DMA傳輸,圖6是外部邏輯讀DMA寫從設備中FIFO的Signal Tap II測試波形圖。從圖中的結果看,數據讀出為1~2 048,實現了激勵數據的正確下載。

          

          6 結語

          本文提出了一種基于方法,這種在線測試方法可以把存儲在FPGA片上FIFO的測試數據通過JTAG接口上傳至PC機并寫入文件,也可以把存儲在PC機上的激勵文件通過JTAG接口下載到FPGA的片上FIFO。相比Altera已有的在線測試方法,此方法采用DMA操作,具有較高的數據吞吐量;采用NiosⅡ控制測試/激勵數據的傳輸,無需手動操作;采集過程的控制由C語言編寫,簡單易用;使用PC機上的激勵文件或者把測試數據存儲為PC機上的文件,可以使用其它分析工具(如Matlab)產生激勵文件或者對測試數據文件進行分析;另外,此方法對測試數據的采樣深度沒有限制。因此,這種在線測試方法具有廣泛的應用前景。


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        關鍵詞: SoPC FPGA在線測試

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