脈沖壓縮技術簡介及其基于FPGA的設計
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本文引用地址：http://www.104case.com/article/246042.htm
圖4 1024點脈沖壓縮狀態FPGA計算結果與MATLAB計算結果對比圖
圖5 512點脈沖壓縮狀態FPGA計算結果與MATLAB計算結果對比圖
圖6 256點脈沖壓縮狀態FPGA計算結果與MATLAB計算結果對比圖
圖4至圖6分別對應時寬為60μs、20μs、6μs，帶寬均為5M的線性調頻信號。其中，左圖對應MATLAB的計算結果，右圖為 FPGA芯片的輸出結果。可以看到，FPGA芯片的輸出結果和MATLAB仿真結果吻合。經測試驗證結果良好，最大誤差不超過-76db，在內部時鐘頻率 80MHz條件下，完成1024點FFT 運行時間為146μs ，滿足了雷達系統實時處理要求，達到了滿意的效果。
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