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        DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)

        作者: 時(shí)間:2008-12-25 來源:網(wǎng)絡(luò) 收藏

        DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)

          考慮到數(shù)字化的優(yōu)越性和系統(tǒng)的穩(wěn)定要求,采用全數(shù)字方案并使用實(shí)現(xiàn)外部模塊。由于MAG輸出信號(hào)的占空比反映了輸入信號(hào)的幅度大小,因此外部控制模塊采用MAG作為輸入信號(hào),檢測(cè)當(dāng)前輸入信號(hào)幅度的變化。外部AGC控制模塊輸出為要衰減的dB值,用來調(diào)整數(shù)控衰減器的衰減量。

          外部AGC控制模塊由計(jì)數(shù)器、低通濾波器、積分器和衰減量dB轉(zhuǎn)換表等幾部分構(gòu)成,實(shí)現(xiàn)框圖如圖2所示。

          當(dāng)放大器2輸出信號(hào)處于射頻前端AGC的動(dòng)態(tài)范圍時(shí),MAG端輸出信號(hào)的占空比為1/3,如圖3所示。如果放大器2輸出信號(hào)超出射頻前端AGC的動(dòng)態(tài)范圍時(shí),中頻連續(xù)信號(hào)的幅度就會(huì)超過正常幅度,直接導(dǎo)致MAG輸出信號(hào)的占空比超出1/3,因此MAG占空比的大小反映了接收信號(hào)幅度的大小。為了保持輸出信號(hào)有恒定占空比,就要在輸入信號(hào)過大而導(dǎo)致內(nèi)部AGC無法調(diào)節(jié)時(shí),采用外部AGC調(diào)整來保證。通過外部AGC控制數(shù)控衰減器調(diào)整輸入信號(hào)幅度,使放大器2的輸出信號(hào)落入射頻前端的AGC動(dòng)態(tài)調(diào)整范圍。數(shù)控衰減量的調(diào)節(jié)直接由射頻前端的輸出信號(hào)MAG的占空比確定。中頻連續(xù)信號(hào)幅度與SNG及MAG輸出信號(hào)的關(guān)系,如圖3所示。

        DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)

          設(shè)射頻前端AGC正常工作時(shí)的中斷頻輸出連續(xù)信號(hào)幅度為A0,則MAG輸出信號(hào)門限為:

        DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)



        關(guān)鍵詞: AGC FPGA

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