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        動(dòng)態(tài)偏振控制器驅(qū)動(dòng)電路分析

        作者: 時(shí)間:2012-02-11 來源:網(wǎng)絡(luò) 收藏
        BORDER-LEFT-WIDTH: 0px; BORDER-BOTTOM-WIDTH: 0px; MAX-WIDTH: 90%; WIDTH: 423px; HEIGHT: 277px; BORDER-RIGHT-WIDTH: 0px" alt=驅(qū)動(dòng)電路 src="/uploadfile/mndz/uploadfile/201202/20120211010114372.jpg">

          LTC1668工作在士5 V雙極性電壓供電情況下,其參考電壓由內(nèi)部提供,輸出采用單端電流輸出模式。寬帶放大器LT1812完成電流一電壓轉(zhuǎn)換,最終輸出符合要求的正弦信號(hào)。

        2.3 軟件設(shè)計(jì)

          FPGA是電路的控制核心。FPGA接收ADC轉(zhuǎn)換的光強(qiáng)信息數(shù)據(jù),并傳送給DSP;再根據(jù)DSP計(jì)算所得的數(shù)據(jù)(即正弦信號(hào)的頻率f)判斷是否符合要求,若符合要求則進(jìn)入DDS子模塊,得到幅度碼并發(fā)送給LTC1668,以輸出需要的正弦波。FPGA主模塊流程圖如圖6(a)所示。

          

        動(dòng)態(tài)偏振控制器驅(qū)動(dòng)電路分析

          

        動(dòng)態(tài)偏振控制器驅(qū)動(dòng)電路分析

          式中:fo是輸出頻率;fref為DDS參考時(shí)鐘頻率,由FPGA將晶振輸入時(shí)鐘經(jīng)內(nèi)部鎖相環(huán)分頻后產(chǎn)生。

          由相位步進(jìn)累加可得到相位碼,再尋址波形存儲(chǔ)器即可完成相位——幅度轉(zhuǎn)換,得到相應(yīng)的幅度碼,輸出給主模塊。由于信號(hào)為正弦波,波形存儲(chǔ)器直接調(diào)用FPGA內(nèi)部模塊sin_COS_lookup_table,輸入與輸出數(shù)據(jù)位寬均為16位。DDS子模塊流程圖如圖6(b)所示。

          2.4 實(shí)驗(yàn)測試結(jié)果

          實(shí)驗(yàn)時(shí)設(shè)定4路正弦驅(qū)動(dòng)信號(hào)V1,V2,V3,V4的頻率分別為f1=2 000 Hz,f2=1 000 Hz,f3=1 800 Hz,f4=1 500 Hz。

          示波器上觀測的波形如圖7所示。

          

        動(dòng)態(tài)偏振控制器驅(qū)動(dòng)電路分析

          波形使用雙通道示波器觀測,2通道探頭設(shè)置為10檔。從圖7中可以看出,輸出波形較為穩(wěn)定。如果在FPGA程序內(nèi)增大sin_COS_lookup_table模塊的輸入數(shù)據(jù)位寬,也即增大采樣點(diǎn)數(shù),可以得到精度更高的輸出波形。

          3 結(jié) 語

          實(shí)驗(yàn)測試結(jié)果表明,所設(shè)計(jì)的調(diào)制電路能夠輸出4路頻率可調(diào)的正弦信號(hào),輸出信號(hào)穩(wěn)定,控制靈活,工作性能可靠。該方法思路簡單,采用Verilog語言設(shè)計(jì)并調(diào)用FPGA內(nèi)部模塊,設(shè)計(jì)靈活透明,且外圍電路較為簡易,具有良好的實(shí)用性和性價(jià)比。


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