通過低電壓差分信號（LVDS）傳輸高速信號

低電壓差分信號(LVDS)非常適合時鐘分配、一點到多點之間的信號傳輸。本文描述了使用LVDS將高速信號分配到多個目的端的方法。

在一個數字系統中，當各個子系統需要相同的參考時鐘源協同工作時，時鐘分配非常重要。例如，一個基站的數字信號處理單元(DSP)，在大部分應用中，必須由射頻處理單元同步。由鎖相環(PLL)產生所需的本振頻率，通過模/數轉換器鎖定到時鐘中心頻率上。同時，當應用系統中包含射頻接收回路時，時鐘(包括信號部分)必須盡可能降低傳輸過程中的電平輻射，使用較低的電平以避免干擾。

將高速信號傳輸到不同目的端時，可以采用多種策略；在這些方案中有兩種極端形式：一、用1個源/驅動器驅動所有目標端(稱為多節點傳輸)；二、每個目標端使用獨立的源/驅動器(稱為多路點到點傳輸)。圖1展示了利用兩種不同技術的傳輸方案的區別。在多節點傳輸方式中，需要一個具有足夠驅動能力的驅動器來驅動所有負載和傳輸介質(電纜、連接器、背板等)。差分總線通常在最后一個接收器處根據特性阻抗進行終端匹配。必須努力使總線上的各支路盡可能短，以避免影響信號的完整性。在電路板布線密度日益提高的今天，有些情況下很難控制分支長度。