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        基于 PCI總線的并聯機床運動控制卡設計

        作者: 時間:2009-04-07 來源:網絡 收藏

        本文引用地址:http://www.104case.com/article/152548.htm

        1 C Y7 C0 9 4 4 9 P V 與 P C機的連接是目前應用最廣泛、最流行的一種高速同步 , 具有 6 4位寬度 , 工作頻率 3 3 MHz , 最大傳輸速率可以達到 1 3 2 Mb / s 。它可將外設直接掛到主機C P U局部總線上并以C P U速度運行,可以大大提 高外設的運行速度。D S P與 P C機 的通信通過連接。 C Y7 C0 9 4 4 9 P V是 Cy p r e s s 公司提供的符合 P C I 2 ―2總線規范的功能完善、價格低廉的雙端口RAM 接 口芯片。其中,一個端 口是 P C I 接口, 適合與P C機通信; 另一端口為本地接口。 它提供主/ 目標接口, 可以同任何通用微處理器連接, 片  內有 1 2 8雙端 口存儲 器用于局部處理器與 P C I 總線數據共享。C Y7 C 0 9 4 4 9 P V與 P C I 總線的連接見圖3 。
          2 P CI 總線開發 方案的實現專用芯片 C Y7 C 0 9 4 4 9 P V采用 3 . 3 V單 電源供電,兼容 3 V和 5 V的P C I 信號環境。電源可由P C I 槽引出,P C I 槽可以提供 3 . 3 V、5 V、電壓 , 在 P C I 槽需特別注意兩個引腳 P RS NT1 和,這兩個引腳接地和懸空的 4種組合直接決定 P C I 卡的功率。 C Y7 C 0 9 4 4 9 P V在使用時, 某些引腳要加阻值為l k f I ~1 0 k f l的下拉或上拉電阻。 根據具體情況, 在該中, S C I 、 S DA、 AI E、/ B E[ 2 ] 、 R DY 一  引腳加上拉電阻, TES T― MODE引腳加下拉電阻。

        是 T I 公 司 新 推 出 的系列 新一 代浮 點 DS P ,它 是在 原來浮點 D S P的基礎上開發的一個價格更低的版本 ,該產品以高速、低功耗 、低成本、易于開發 為顯著 的特點 ] 。由于它采用 了內部 1 . 8 V、外部. 3 V供電 ,因而功耗比原有型號降低 了大約一個數  量級, 而且能支持高達 1 5 O ×1 0 次/ s的運行速度,是需浮點運算的便攜式產品中的一種理想的 DS P器件 。
          作為控制系統的核心, TMS 3 2 O VC3 3主要完成實時中斷的伺服控制程序 ,包括對各種底層硬件的操作。它采用 3 2 位局部總線接 口方式, 時鐘信號可以是單獨提供的時鐘源,也可以是 C Y7 C O 9 4 4 9 P V提供的 P C I 時鐘信號 P C I KO UT[ 2 O ] 中任意的一個。
          結束語并聯需要控制的軸數比較多,而且牽涉到并聯機構的正逆解運算 ,運算量比較大,采用總線的,整個數控系統的任務就由 P C機和來共同承擔 ,在開放式數控系統中能夠發揮出理想的控制性能。隨著數控系統的普及和產品檔次的提高,這種運動將會有廣泛的應用前景 。

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