基于FPGA的雙模前置小數分頻器的設計
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4 波形仿真
上述的÷8/9雙模前置分頻器的描述程序經ModelSim編譯、時序模擬后，得到的波形如圖2所示。
由圖2可見，當reset為0時，分頻器復位，當a為1時，進行8分頻，當a為0時則進行9分頻。
如圖3所示，在前3個時鐘，a值為0，則進行9分頻，其后一個時鐘a為1，進行8分頻，后兩個脈沖，又進行9分頻，后進行一次8分頻，然后又進行兩次9分頻，最后進行一次8分頻。
5 電路實現
FPGA現場可編程門陣列（FieldProgrammableGateArray）是20世紀80年代中期出現的高密度可編程邏輯器件。FPGA及其軟件系統是開發數字電路的最新技術。他利用EDA技術，以電路原理圖、硬件描述語言、狀態機等形式輸入設計邏輯；他提供功能模擬、時序仿真等模擬手段，在功能模擬和時序仿真度滿足要求后，經過一系列的變換，將輸入邏輯轉換成FPGA器件的編程文件，以實現專用集成電路。本設計選用Xilinx公司推出的90nm工藝制造的現場可編程門陳列Spartan-3來設計小數分頻器，體積減小，可靠性提高。
6 結語
采用前置雙頻分頻器設計的小數分頻器，小數分頻器的精度受控制計數器的影響，當n值為100時，小數分頻的精度達到1/100；當n值為1000時，小數分頻的精度達到1/1000；依此類推。FPGA有相當豐富的硬件資源，因此可以用FPGA設計高精度的小數分頻器。采用FPGA組成的數字頻率合成器，單環鑒相頻率達100MHz以上，分辨率可達10－6。這種小數分頻器得到了廣泛的應用，例如，對圖象采集系統中的行分頻和列分頻的設計，就可以應用本分頻器電路作為時鐘發生器。本文引用地址：http://www.104case.com/article/151353.htm
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