基于DDS+PLL技術的頻率合成器的設計
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本設計中，AD9852采用SINGLE TONE模式，為ADF4360-7提供穩定的10 MHz頻率作為其參考信號源。ADF4360-7采用的分頻比尺為10，VCO輸出頻率可通過公式(7)計算得出：
其中，P為前置預置分頻比，本設計中取P值為8。
2．3 測試結果
根據上文中對各參考部分的設計，通過使用示波器對各頻率點分別進行測試。其中，經R分頻后得到1 MHz的鑒相頻率，N計數器可用公式N=B×P+A進行計算，即設計寄存器A、B的參數，就可改變N的取值。
在測試的過程中，首先測試AD9852當前所產生的頻率，該頻率作為鎖相環的信號源，提供的是穩定的10 MHz信號，測試結果如圖3所示。理論輸出值為10 MHz，實際的輸出值為10．46 MHz，考慮到測量誤差等因素，該輸出頻率符合設計的要求。本文引用地址：http://www.104case.com/article/150459.htm
DDS的輸出頻率經鎖相環倍頻后，從低頻信號倍頻至高頻信號，通過對750 MHz、800 MHz、850 MHz、960 MHz幾個頻率點分別進行測試。測試結果如圖4、圖5、圖6、圖7所示。測試結果均是以850 MHz做為中心頻率，每格為100 MHz作為標準，其測試結果分別為752．83MHz，798．85 MHz，851．84 MHz，960．25 MHz，均在允許的誤差范圍內。
3 結束語
本文提出以DDS產生的低頻點信號做為鎖相環的參考頻率源，從而通過倍頻產生高頻頻率的輸出的方案。在設計中，ADF4360-7芯片內部集成了VCO，節約了設計成本，且為超寬帶雷達信號的產生奠定了基礎。本設計方案基本得到了較好的測試結果，整個系統工作穩定，性能優良。
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