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SerDes
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一個用于測量，識別和消除對高速串行通信鏈路的時鐘和數(shù)據(jù)抖動的建議框架
積分：0分
Maxim
jitter
clock jitter
data jitter
high-speed serial
signal integrity
SERDES
serializer-deserializer
clock and data recovery
CDR
jitter tolerance
CPRI
common public radio interface
bit error rate
BER
deterministic jitter
random jitter
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soothmusic
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內(nèi)置誤碼率測試電路中使用的2.5Gbps SerDes的測量鏈路質量容易
積分：0分
Maxim
high speed interconnect
GMSL
BER
eye diagram
pre-emphasis
equalization
serializer
deserializer
serdes
PRBS
|
soothmusic
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在Maxim GMSL SerDes器件中預加重和均衡
積分：0分
Maxim
serializer
deserializer
SerDes
preemphasis
equalization
STP
shielded twisted pair
video
high speed data
cable compensation
GMSL
gmsl
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內(nèi)置誤碼率測試電路中使用的2.5Gbps SerDes的測量鏈路質量容易
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Maxim
high speed interconnect
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pre-emphasis
equalization
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在Maxim GMSL SerDes器件預加重和均衡
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一個用于測量，識別和消除對高速串行通信鏈路的時鐘和數(shù)據(jù)抖動的建議框架
積分：0分
Maxim
jitter
clock jitter
data jitter
high-speed serial
signal integrity
SERDES
serializer-deserializer
clock and data recovery
CDR
jitter tolerance
CPRI
common public radio interface
bit error rate
BER
deterministic jitter
random jitter
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【用戶指南】Altera收發(fā)器PHY IP核用戶指南(Altera Transceiver PHY IP Core User Guide)
積分：0分
Altera
transceiver
xcvr
SERDES
TX
RX
10GBASE-R
XAUI
Interlaken
PCI Express PIPE
custom
low latency
deterministic latency
PHY
IP core
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一個用于測量，識別和消除對高速串行通信鏈路的時鐘和數(shù)據(jù)抖動的建議框架
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data jitter
high-speed serial
signal integrity
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serializer-deserializer
clock and data recovery
CDR
jitter tolerance
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一個用于測量，識別和消除對高速串行通信鏈路的時鐘和數(shù)據(jù)抖動的建議框架
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【應用手冊】AN 571: Implementing the SERDES Framer Interface Level 5 (SFI-5.1) Protocol in Stratix IV Devices
積分：0分
Altera
FPGA
Stratix IV
SERDES Framer Interface Level 5 (SFI-5.1) Protocol
|
bobgeng
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【應用手冊】AN 572: Implementing the Scalable SERDES Framer Interface (SFI-S) Protocol in Stratix IV GT Devices
積分：0分
Altera
FPGA
Stratix IV GT
Scalable SERDES Framer Interface protocol
|
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內(nèi)置誤碼率測試電路中使用的2.5Gbps SerDes的測量鏈路質量容易
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高速串行I/O技術: SERDES
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高速串行I/O技術
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