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        fpga+arm 文章 最新資訊

        一種FFT插值正弦波快速頻率估計(jì)算法

        • 對被噪聲污染的正弦波信號進(jìn)行頻率估計(jì)是信號參數(shù)估計(jì)中的經(jīng)典問題,目前國內(nèi)外已提出不少方法。文獻(xiàn)給出了在高斯白噪聲中對正弦波信號頻率進(jìn)行最大似
        • 關(guān)鍵字: FPGA  

        整合ARM、FPGA與可編程模擬電路的單芯片方案

        • 現(xiàn)在設(shè)計(jì)人員不僅要從多種處理器架構(gòu)中進(jìn)行選擇(大多數(shù)嵌入式系統(tǒng)設(shè)計(jì)都以處理器內(nèi)核為中心),而且外設(shè)、通信端口和模擬功能組合的選擇幾乎無限。而這
        • 關(guān)鍵字: 芯片  FPGA  ARM  

        基于FPGA的多端DRI電源逆變器的控制算法的實(shí)現(xiàn)

        • 賽靈思SPARTAN-3A FPGA 可強(qiáng)化面向多端DRI 電源逆變器的控制算法實(shí)現(xiàn)方案面向工業(yè)應(yīng)用的產(chǎn)品開發(fā)需要在時(shí)限和產(chǎn)品規(guī)范不斷變化的環(huán)境中進(jìn)行廣泛的研究
        • 關(guān)鍵字: FPGA  通信  

        基于FPGA可編程振蕩器增強(qiáng)

        • 當(dāng)今復(fù)雜的 FPGA 含有眾多用于實(shí)現(xiàn)各種電路與系統(tǒng)的功能塊,諸如邏輯陣列、存儲器、DSP 模塊、處理器、用于時(shí)序生成的鎖相環(huán) (PLL) 和延遲鎖定環(huán) (DLL
        • 關(guān)鍵字: FPGA  控制  

        基于FPGA的三相正弦DDS電路的設(shè)計(jì)與實(shí)現(xiàn)

        • 1. 引言直接數(shù)字頻率合成器(DDS)技術(shù),是根據(jù)相位的概念出發(fā)直接合成所需的波形的一種 新的頻率合成原理,是一種把一系列數(shù)字形式的信號通過DAC轉(zhuǎn)換成模
        • 關(guān)鍵字: 控制  FPGA  

        基于Xilinx Zynq SoC的解決方案

        • 在移動互聯(lián)、智能終端的高速發(fā)展和普及下,網(wǎng)絡(luò)熱點(diǎn)和盲點(diǎn)急需靈活的方案來完善覆蓋。 由于基站選址和工程施工難度越來越大,施工成本越來越高,基站設(shè)
        • 關(guān)鍵字: FPGA  控制  

        基于Nios軟CPU內(nèi)核的FPGA非線性校正方案

        • 1. 引言O(shè)FDM能有效抑制多徑信道引起的深度衰落、抵抗脈沖噪聲和具有較高的頻譜效率的特點(diǎn)。但是OFDM的傳輸符號是多載波的QAM信號經(jīng)過IFFT處理后得到的
        • 關(guān)鍵字: 射頻  FPGA  

        詳解ARM處理寄存器與用戶模式

        • ARM處理器共有37個(gè)寄存器,被分為若干個(gè)組(BANK),這些寄器包括:● 31個(gè)通用寄存器,包括程序計(jì)數(shù)器(PC指針),均為32位的寄存器。● 6個(gè)狀態(tài)寄存器,
        • 關(guān)鍵字: ARM  處理寄存器  用戶模式  

        基于FPGA的簡易電壓表設(shè)計(jì)

        •   傳統(tǒng)的數(shù)字電壓表設(shè)計(jì)通常以大規(guī)模ASIC(專用集成電路)為核心器件,并輔以少量中規(guī)模集成電路及顯示器件構(gòu)成。這種電壓表的設(shè)計(jì)簡單、精確度高,但是由于采用了ASIC器件使得它欠缺靈活性,其系統(tǒng)功能固定,難以更新擴(kuò)展。而應(yīng)用FPGA設(shè)計(jì)的電壓表,采用FPGA芯片控制通用A/D轉(zhuǎn)換器,可使速度、靈活性大大優(yōu)于通用數(shù)字電壓表。、  本文采用STEP-MAX10M08核心板和STEP Base Board V3.0底板來完成簡易電壓表設(shè)計(jì),我們將設(shè)計(jì)拆分成三個(gè)功能模塊實(shí)現(xiàn):  ADC081S101_driver
        • 關(guān)鍵字: FPGA  ASIC  

        基于FPGA的嵌入式視覺的應(yīng)用

        • 什么樣的積極創(chuàng)新可以幫助您設(shè)計(jì)出這樣一個(gè)系統(tǒng)mdash;mdash;它能夠提醒用戶有兒童在游泳池中溺水,或是有入侵者試圖闖入住宅或者辦公場所?這種技術(shù)還
        • 關(guān)鍵字: 嵌入式  FPGA  

        加快設(shè)計(jì)流程的兩種嵌入式系統(tǒng)開發(fā)方案的設(shè)計(jì)

        • 在日益信息化的現(xiàn)代社會中,計(jì)算機(jī)和網(wǎng)絡(luò)的應(yīng)用已經(jīng)全面滲透到日常生活中,各種應(yīng)用嵌入式系統(tǒng)的電子產(chǎn)品也隨處可見,計(jì)算機(jī)的應(yīng)用經(jīng)過桌面PC系統(tǒng)的空
        • 關(guān)鍵字: 嵌入式  FPGA  

        采用帶有收發(fā)器的全系列40-nm FPGA 和ASIC 實(shí)現(xiàn)創(chuàng)新設(shè)計(jì)

        • 人們對寬帶服務(wù)的帶寬要求越來越高,促使芯片供應(yīng)商使用更多的高速串行收發(fā)器。因此,下一代應(yīng)用采用了多種數(shù)據(jù)速率,從幾Mbps 到數(shù)百Gbps,在一種
        • 關(guān)鍵字: FPGA  ASIC  40  nm  

        基4-FPGA的大動態(tài)范圍數(shù)字AGC的實(shí)現(xiàn)

        • 1 引言在數(shù)字中頻接收機(jī)中,把A/D轉(zhuǎn)換提前到中頻部分,為保證A/D轉(zhuǎn)換的動態(tài)范圍和系統(tǒng)帶寬,要求低噪聲放大器和自動增益控制AGC(Automatic Ga
        • 關(guān)鍵字: FPGA  AGC  動態(tài)范圍  數(shù)字  

        基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計(jì)與實(shí)現(xiàn)

        • 要CORDIC(COordination Rotation DIgital Computer)算法實(shí)現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號的實(shí)現(xiàn)過程,然后給出了
        • 關(guān)鍵字: FPGA  正交數(shù)字  混頻器  數(shù)控振蕩器  

        積分梳狀濾波器的FPGA實(shí)現(xiàn)

        • 本文提出了多級CIC抽取濾波器結(jié)構(gòu)不僅能夠?qū)崿F(xiàn)更寬輸入信號的任意速率的抽取,并且對帶外信號的衰減也更大。
        • 關(guān)鍵字: FPGA  積分  梳狀濾波器  
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