- 2008年11月11號，北京——Altera公司(NASDAQ: ALTR)今天宣布，Dini集團在其業界容量最大的單板FPGA原型引擎中采用了具有340K邏輯單元(LE)的Stratix® III EP3SL340 FPGA。DN7020K10采用了1,760引腳封裝的20片EP3SL340 FPGA，每個器件提供1,104個用戶I/O，容量等價于5千萬ASIC邏輯門。客戶設計無線通信、網絡和圖形處理應用等定制ASIC時，可以利用這一超大容量原型電路板來驗
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Altera Dini集團 Altera Stratix III FPGA ASIC
- “嵌入式系統”這個詞范圍很廣，從數字式電子表到變電站電力檢測系統中的PC都可歸于這一范疇。大多數情況...
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FPGA 嵌入式
- 問題描述：81%的電子系統中在使用FPGA，包括很多商用產品和國防產品，并且多數FPGA使用的是BGA封裝形式...
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FPGA PCB BGA
- 隨著我國汽車工業的高速發展，許多家庭擁有了自己的私家車，但車庫的數量遠遠滿足不了需求，因此，如何有效地防止汽車被盜是車主們最關心的問題。近年來，科學技術迅猛發展，結合各種新技術的新型汽車防盜裝備相繼出現。由于目前車載系統的功能正在逐步的增強、增多，采用單片機的控制已越來越無法適應需求。所以在汽車電子中采用嵌入式技術將成為必然。
本文采用嵌入式技術開發車載防盜裝置，一方面能增強控制能力，提高汽車防盜的智能化程度。另一方面，縮小了裝置的體積，提高了該裝置應用的靈活性，同時也為將來進一步增強汽車電子的
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ARM
- 實時信號處理系統要求必須具有處理大數據量的能力,以保證系統的實時性;其次對系統的體積、功耗、穩定性...
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DSP FPGA 信號處理 實時操作
- 2008 年 10 月 14日，北京訊 — 賽普拉斯半導體公司中國業務運營部與賽普拉斯大學聯盟 (CUA) 協力共同為中國的名牌大學清華大學 (THU) 提供 PSoC? 器件及相關套件。相關工作取得了顯著成效，PSoC 在兩門課程的學習中得到全面推廣，并幫助 100 多名學生了解到如何用賽普拉斯業界領先的可編程片上系統解決方案設計復雜的系統。
清華大學自動化系與清華大學科教儀器設備廠攜手開發了 PSoC 實驗室套件。該套件于去年春天獲得了清華大學頒發的“第10屆
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賽普拉斯 PSoC FPGA
- 由于高科技工具成為抓捕罪犯的武器中越來越關鍵的部分，因此執法機構和安全專業人員不斷尋求更快更方便的數據...
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FPGA 汽車電子 語音 視頻
- 設計背景
串口即通用異步收發器（UART，Universal Asynchronous Receiver Transmitter）。串行通信具有傳輸線少、成本低、可靠性高等優點，所以系統間互聯常采用RS-232接口方式，一般該接口由UART 專用芯片來實現。但UART接口芯片一般引腳較多，內含許多輔助模塊和一些輔助功能，在實際使用時往往用不到這些功能，因此若采用UART專用芯片，必將使電路變得復雜，PCB面積增大，從而導致成本增加，系統的穩定性和可靠性降低。基本的UART通信只需要兩條信號線（R
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FPGA UART 接口技術
- ??? Tech?Insights/Embedded?Systems?Design?2008年嵌入式市場調研報告表明，嵌入式系統設計人員在2008年要參與更多項目的開發，按期完成開發任務是他們最大的問題，有一半以上（大于50%）的開發項目不能按期完成。
調查結果表明：自2005年以來，2008年新項目對應項目改進的比例是這幾年中最高的。在所有開發項目中，新開發項目占46%，剩余54%為以往開發項目的升級和改進。項目的改進和升級主
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嵌入式 工程師 FPGA
- 賽靈思公司日前宣布推出 Virtex-5 FXT FPGA ML510 嵌入式開發平臺，用于開發支持雙處理器的高性能嵌入式系統。這一新的開發平臺基于集成雙 Power PC? 440處理器的 Virtex-5 FXT FPGA，并且可以支持 Linux和VxWorks 操作系統，為軟件和硬件設計團隊提供了無與倫比的靈活性和計算能力。
結合豐富的參考設計和由屢獲殊榮的開發工具、配置向導和 IP 組成的賽靈思嵌入式開發套件（EDK），ML510 嵌入式開發平臺為構建利用雙處理器完成專用分配功
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xilinx FPGA WiMAX
- l 引言
與傳統模擬示波器相比．數字存儲示波器不僅具有可存儲波形、體積小、功耗低，使用方便等優點，而且還具有強大的信號實時處理分析功能。在電子測量領域，數字存儲示波器正在逐漸取代模擬示波器。但目前我國使用高性能數字存儲示波器主要依靠國外產品，而且價格昂貴。因此研究數字存儲示波器具有重要價值。借于此，提出了一種簡易數字存儲示波器的設計方案，經測試，性能優良。
2 數字存儲示波器基本工作原理
數字存儲示波器與模擬示波器不同在于信號進入示波器后立刻通過高速A／D轉換器將模擬信號前端快速采樣，存儲其
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單片機 FPGA 放大器 示波器
- 1 引言
傳統測試測量儀存在價格昂貴、體積龐大、數據傳輸速率低、存儲顯示困難等問題，本文選用FPGA實現數據處理、邏輯控制，充分利用PC機，結合Labwindows圖形化上層應用軟件界面生成的虛擬測試系統具有較強的競爭力。本系統在FPGA單板單片主控器件控制下，實現兩路獨立、幅值可控的信號發生器，一路虛擬存儲示波器，具有外部觸發信號和采樣時鐘的16路高速邏輯分析儀。
2硬件設計
2.1硬件系統框圖
硬件系統設計是以并行處理能力強、可重配置的低端FPGA單片EP1C6為主控器件。圖1所示為硬
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虛擬測試 FPGA
- 引 言
RC6是作為AES(Advanced Encryption Standard)的候選算法提交給NIST(美國國家標準局)的一種新的分組密碼。它是在RC5的基礎上設計的，以更好地符合AES的要求，且提高了安全性，增強了性能。根據AES的要求，一個分組密碼必須處理128位輸入／輸出數據。盡管RC5是一個非常快的分組密碼，但它處理128位分組塊時用了2個64位工作寄存器；而AES目前在講究效率和簡潔方面不支持64位操作，于是RC6修正這個錯誤，使用4個32位寄存器而不是2個64位寄存器，以更好地實
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FPGA RC6
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