- 隨著設計量和復雜度的不斷增加，數字設計驗證變得越來越難，所消耗的成本也越來越高。面對這種挑戰，驗證工程師必須依靠相應的驗證工具和方法才行。對于大型的設計，比如上百萬門的設計驗證，工程師必須使用一整套規范的驗證工具；而對于較小的設計，使用具有HDL testbench的仿真器是一個不錯的選擇。
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仿真驗證 仿真測試文件 FPGA Testbench
- 進入波形仿真后點擊運行按鈕即可出波形，下面我們來驗證我們的cpu代碼是否正確
大家先看兩個圖，等會小墨同學會結合這兩個圖給大家細細講解仿真過程
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我們先來看第一個過程
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上電后，cpu先從ROM中讀回兩個周期的數據，是從ROM的0地址開始的，再對比我們之前定義好的ROM，數據讀取正確，讀回的數據的前三位是111，即指令碼JMP，后13位003c為地址碼，JMP指令是將讀回的數據
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FPGA testbench
- 本文敘述概括了FPGA應用設計中的要點，包括，時鐘樹、FSM、latch、邏輯仿真四個部分。
FPGA的用處比我們平時想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來的簡單邏輯單元(LE)。
早期的FPGA相對比較簡單，所有的功能單元僅僅由管腳、內部buffer、LE、RAM構建而成，LE由LUT(查找表)和D觸發器構成，RAM也往往容量非常小。
現在的FPGA不僅包含以前的LE，RAM也更大更快更靈活，管教IOB也更加的復雜，支持的IO類型也更多，而且內部還集成了一
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FPGA Testbench
- Testbench，就是測試平臺的意思，具體概念就多不介紹了，相信略懂FPGA的人都知道，編寫Testbench的主要目的是為了對使用硬件描述語言(HDL)設計的電路進行仿真驗證，測試設計電路的功能、部分性能是否與預期的目標相符。
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FPGA Quartus Testbench 開發板 異步復位
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