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面向5G且完全集成參考時鐘的抖動衰減器 簡化高速網(wǎng)絡(luò)時鐘設(shè)計(jì)
- 中國，北京 - 2019年6月20日 - Silicon Labs （亦稱“芯科科技”，NASDAQ：SLAB）日前擴(kuò)展了Si539x抖動衰減器系列產(chǎn)品，其新器件型號具有完全集成的參考時鐘、增強(qiáng)了系統(tǒng)可靠性和性能，同時簡化了高速網(wǎng)絡(luò)設(shè)計(jì)中的PCB布局布線。新型Si539x抖動衰減器設(shè)計(jì)旨在滿足100/200/400/600/800G設(shè)計(jì)中苛刻的參考時鐘要求，為最先進(jìn)的以太網(wǎng)交換機(jī)SoC、PHY、FPGA和ASIC中56G PAM-4 SerDes所需的嚴(yán)格抖動要求提供超過40％的余量，同時也為新興的112
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