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        基于FPGA的SDX總線與Wishbone總線接口設(shè)計

        • 摘要 針對機(jī)載信息采集系統(tǒng)可靠性、數(shù)據(jù)管理高效性以及硬件成本的需求,介紹了基于硬件描述語言Verilog HDL設(shè)計的SDX總線與Wishbo ne總線接口轉(zhuǎn)化的設(shè)計與實現(xiàn),并通過Modelsim進(jìn)行功能仿真,在QuartusⅡ軟件平臺上綜
        • 關(guān)鍵字: Wishbone  FPGA  SDX  總線    
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