【直播】來與ZEISS聊電子質控新時代下的技術
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基于Verilog狀態機的PLC背板總線協議接口芯片設計
設計了一組基于CPLD的PLC背板總線協議接口芯片,協議芯片可以區分PLC的背板總線的周期性數據和非周期性數據。詳細介紹了通過Verilog HDL語言設計狀態機、協議幀控制器、FIFO控制器的過程,25MHz下背板總線工作穩定的試驗結果驗證了協議芯片設計的可行性。
關鍵字:
VerilogHDL
PLC背板
CPLD
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