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硅設計鏈廠商通力合作 降低90納米芯片總功耗
- 3月21日，硅設計鏈產業協作組織（Silicon Design Chain Initiative）的半導體工業領導廠商宣布，經流片驗證的低功耗90納米芯片設計技術可使芯片的總功耗降低40％。 該低功耗設計采用了多個廠商的先進技術：ARM1136JF-S™測試芯片，ARM® Artisan®標準設計單元庫和存儲單元，Cadence Encounter
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