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基于FPGA的高精度時間數字轉換電路的設計與實現

• 本文介紹一種基于 FPGA高精度時間數字轉換電路的設計方法，利用片內鎖相環（PLL）和環形移位寄存器，采用不高的系統時鐘便可得到很高的時間分辨率，且占用較少邏輯資源。可作為功能電路獨立使用，也可作為 IP核方便地移植到其他片上系統（SOC）中。在 Altera公司的 Stratix和 Cyclone系列芯片上實現時，時間分辨率昀高可達 3.3ns。時序仿真和硬件測試表明該方法的可行性和準確性。
• 關鍵字： 時間數字轉換電路  激光探測  FPGA