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意法負(fù)責(zé)歐洲低功耗納電子研究項目

• 意法半導(dǎo)體宣布該公司被任命為歐洲新的集成電路研究項目CLEAN（NanoCMOS 系統(tǒng)芯片泄漏功率控制）的負(fù)責(zé)人。 這個為期三年的研究項目是由歐洲委員會提供資金的，項目目標(biāo)是探討65nm以下CMOS設(shè)計的泄漏電流的控制方法，延長電池使用壽命，降低電子產(chǎn)品功耗。 隨著65nm以下制造技術(shù)的芯片的快速發(fā)展，降低泄漏電流成為一個越來越重要的問題。電路設(shè)計工程師承認(rèn)，如果不能找到并采用一個適當(dāng)?shù)膶Σ撸孤╇娏鲗⑹怯绊懴乱淮娐芳跋到y(tǒng)呈現(xiàn)精彩紛呈的應(yīng)用性能的主要障礙。  要想在市場上取
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