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- 關鍵字：
DSP架構 數字PLL 數字振蕩器
- 多年以來，作為業界主流產品的模擬PLL已被熟知，模擬PLL性能穩定，可為頻率合成和抖動消除提供低成本的解決方案，工作頻率高達8GHz及以上。然而新興的基于直接數字頻率合成（DDS）的數字PLL在某些應用中極具競爭力。
數字PLL利用數字邏輯實現傳統的PLL模塊。雖然實現數字PLL的方法有很多，但本文只介紹基于DDS的數字PLL架構。
圖1 典型的模擬PLL結構框圖
圖1所示的是典型的模擬PLL。輸入信號首先進入參考分頻器，參考分頻器可降低輸入鑒相器的信號頻率。在PLL中，參考分頻器的
- 關鍵字：
DDS 數字PLL
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