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        平臺(tái)設(shè)計(jì) 文章 最新資訊

        一種基于FPGA/DSP的靈巧干擾平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

        • 引 言
          目前,通信干擾的手段以信號(hào)大功率壓制為主,本質(zhì)上屬于物理層能量干擾,存在效費(fèi)比低,且容易暴露自身目標(biāo)等缺點(diǎn),而且隨著新的功率控制和信號(hào)處理技術(shù)的應(yīng)用,通信大功率壓制干擾手段的應(yīng)用遇到了瓶頸。
        • 關(guān)鍵字: FPGA  DSP  干擾  平臺(tái)設(shè)計(jì)    

        基于FPGA的可配置通信平臺(tái)設(shè)計(jì)

        • 本文設(shè)計(jì)了一種基于FPGA的、通用可配置的通信開(kāi)發(fā)與測(cè)試平臺(tái)。針對(duì)不同信道編碼和調(diào)制方式的組合,通過(guò)采用實(shí)時(shí)軟硬件重構(gòu)技術(shù),該平臺(tái)可以在短期內(nèi)完成相應(yīng)通信系統(tǒng)的構(gòu)建、驗(yàn)證和配置。
        • 關(guān)鍵字: FPGA  可配置  通信  平臺(tái)設(shè)計(jì)    

        基于RVM的層次化SoC芯片驗(yàn)證平臺(tái)設(shè)計(jì)及應(yīng)用

        • 本文以SIM卡控制模塊的功能驗(yàn)證為例,介紹了運(yùn)用Synopsys Vera驗(yàn)證工具以及RVM驗(yàn)證方法學(xué)快速高效地搭建高質(zhì)量驗(yàn)證平臺(tái)的方法。文中詳細(xì)介紹了RVM驗(yàn)證方法學(xué)以及RVM驗(yàn)證平臺(tái)的結(jié)構(gòu)。
        • 關(guān)鍵字: RVM  SoC  芯片驗(yàn)證  平臺(tái)設(shè)計(jì)    
        共18條 2/2 « 1 2

        平臺(tái)設(shè)計(jì)介紹

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