密碼算法 文章 最新資訊
基于FPGA的稅控算法加密卡設(shè)計(jì)與實(shí)現(xiàn)
- 由于當(dāng)前國稅、地稅、各省、各稅種發(fā)票不同，辨別難度較大，因此給造假者可乘之機(jī)。本文設(shè)計(jì)的基于FPGA的稅控算法加密卡可有效地解決上述問題，提供了高效的防偽措施。該加密卡通過PCI總線內(nèi)置于稅控加密機(jī)中，將發(fā)
- 關(guān)鍵字： FPGA PCI DMA 密碼算法 狀態(tài)機(jī)
一種AES密碼算法的硬件實(shí)現(xiàn)
- 介紹了一種適用于較小面積應(yīng)用場(chǎng)合AES密碼算法的實(shí)現(xiàn)方案。結(jié)合該算法的特點(diǎn)，在常規(guī)輪變換中提出一種加／解密列混合變換集成化的硬件結(jié)構(gòu)設(shè)計(jì)，通過選擇使用同一個(gè)模塊，可以實(shí)現(xiàn)加密和解密中的線性變換，既整合了部分加／解密硬件結(jié)構(gòu)，又節(jié)約了大量的硬件資源。仿真與綜合結(jié)果表明，加／解密運(yùn)算模塊面積不超過25 000個(gè)等效門，有效地減小了硬件實(shí)現(xiàn)面積，同時(shí)該設(shè)計(jì)方案也滿足實(shí)際應(yīng)用性能的需求。
- 關(guān)鍵字： AES 密碼算法 硬件實(shí)現(xiàn)
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