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基于LVDS的超高速ADC數(shù)據(jù)接收設(shè)計(jì)
- 摘要：超高速ADC通常采用LVDS電平傳輸數(shù)據(jù)，高采樣率使輸出數(shù)據(jù)速率很高，達(dá)到百兆至吉赫茲量級，如何正確接收高速LVDS數(shù)據(jù)成為一個(gè)難點(diǎn)。本文以ADS42LB69芯片的數(shù)據(jù)接收為例，從信號傳輸和數(shù)據(jù)解碼兩方面，詳述了實(shí)
- 關(guān)鍵字： LVDS ADC數(shù)據(jù)接收信號 完整性FPGA
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