- 摘要：本文采用博亞20MHz高穩定度晶體振蕩器、集成VCO的低相位噪聲鎖相環時鐘芯片LMX2531、高精度時鐘扇出器HMC987LP5E和多階低通濾波器，實現具有低相噪特性的4路并行輸出、頻率最高為2.5GHz的高速時鐘電路的設計。
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高速時鐘 ADC 201207
- 摘要：對多標準無線通信系統中的A／D轉換器進行了研究，根據無線通信系統的特點，構建了一個新型可重構流水線A／D轉換器結構，該A／D轉換器的可重構功能是通過在低分辨率下關斷子級流水線來實現的。轉換器的系統指標
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設計 ADC 流水線 重構
- 0 引言 模數轉換器(ADC)在信號處理中起了一個非常重要的作用。在數字音頻、數字電視、圖像編碼及頻率合 ...
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三階 單環 調制器 ADC
- Maxim 高速ADC MAX12559 MAX2055 MAX2027 緩沖器現代通信系統創新設計主要表現在直接變頻和高中頻架構，全數字接收機的設計目標要求模數轉換器(ADC)以更高的采樣率提供更高的分辨率(擴大系統的動態范圍)。在新興的3G
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ADC 緩沖放大器
- ADC 雙積分式1.轉換方式V-T型間接轉換ADC。2. 電路結構圖11.11.1是這種轉換器的原理電路，它由積分器(由集成運放A組成)、過零比較器(C)、時鐘脈沖控制門(G)和計數器(FF0～FFn)等幾部分組成。 圖11.11.1 雙積分A/D轉
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ADC 雙積分 模數轉換器
- ADC 并行比較型1.轉換方式直接轉換ADC。2.電路結構3位并行比較型A/D轉換器原理電路如圖11.9.1所示。它由電阻分壓器、電壓比較器、寄存器及編碼器組成。
圖11.9.1 3位并行A/D轉換器3.工作原理圖中的8個電阻將參考電
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ADC 并行 比較
- ADC 逐次比較型1.轉換方式直接轉換ADC2.電路結構逐次逼近ADC包括n位逐次比較型A/D轉換器如圖11.10.1所示。它由控制邏輯電路、時序產生器、移位寄存器、D/A轉換器及電壓比較器組成。
圖11.10.1逐次比較型A/D轉換器框
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ADC 比較
- 這種設計方案針對低檔八管腳flash存儲的8位微處理器，例如Freescale的MC68HC908QT4A，但是它也同樣適用于任何一款擁有ADC模塊的8位微處理器。在芯片內，ADC轉換輸入的模擬電壓成數字信號格式。數字信號格式為8位的十
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ADC 微處理器 電壓 編碼
- 例1 利用驅動庫函數的8x過采樣代碼段1.a ADC配置－驅動庫函數// // 初始化ADC，使用定序器0對通道1進行8x過采樣// 定序器將被其中一個通用定時器觸發// ADCSequenceConfigure(ADC_BASE, 0, ADC_TRIGGER_TIMER, 0);
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采樣 技術 ADC 控制器 系列 Stellaris
- 概述 Luminary Micro在Stellaris系列微控制器的部分產品中提供了模數轉換器（ADC）模塊。ADC的硬件分辨率為10位，但由于噪音和其它使精度變
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采樣 技術 ADC 控制器 系列 Stellaris
- LTC?2440 是一款具有 5ppm INL 和 5μV 偏移的高速 24 位無延遲增量累加 (No Latency ΔΣTM) ADC。它采用 ...
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可變速度 分辨率 ADC LTC2440
- 摘要：行為級仿真是提高流水線(pipeline)ADC設計效率的重要手段。建立精確的行為級模型是進行行為級仿真的關鍵。本文采用基于電路宏模型技術的運算放大器模型，構建了流水線ADC的行為級模型并進行仿真。為驗證提出模
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仿真 行為 ADC 流水線
- 摘要：介紹德州儀器公司最近出品的帶有高性能8051內核的系統級ADC芯片——MSC1210。說明8051內核單片機的特點、懷能以及片上Flash、24位高精度A/D轉換器的使用方法。利用MSC1210豐富的片上資源，可以很簡單
- 關鍵字：
介紹 應用 MSC1210 芯片 ADC 系統
- 電路功能與優勢圖1所示電路使用超低功耗、18位1 MSPS ADC AD7982 ，由低功耗全差分放大器ADA4940-1來驅動。低噪聲精密5.0V基準電壓源 ADR395用于提供該ADC所需的5V電源。圖1所示的所有IC均采用3 mm times; 3 mm LFC
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PULSAR 0237 ADC CN
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