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        EnDat接口編碼器數據采集設計方案

        作者: 時間:2013-04-07 來源:網絡 收藏
        位置值如果帶附加信息,緊接在位置值后的是附加信息1和2,他們也各以一個CRC結束。附加信息的內容由存儲區的選擇地址決定,然后在后面的采樣周期里被傳輸。在后續的傳輸中一直傳輸該信息,直到新的存儲區被選擇。在數據字的結尾,時鐘信號必須置高電平。10us到30us或1.25us到3.75us(EnDat2.2可編程的恢復時間tm)后,數據線回到低電平,然后,新的數據傳輸可在新的時鐘信號下開始。

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        圖3 帶附件信息的位置傳輸同時,為參數提供了不同的存儲區,它們可以被后續電子設備讀取,這些區域可以被制造商、OEM廠商甚至最終用戶寫入。一些特定的區域是可以被寫保護的。不同系列的支持不同的OEM存儲區和不同的地址范圍。因此,每一個編碼器必須讀取OEM存儲區的分配信息。基于此原因,后續電子電路應基于相對地址編程,而不能使用絕對地址。

        后續電子設備的電路設計方案

        使用者可以根據協議和電路電氣特性自行設計接口電路進行與處理,同時海德漢也提供了特定的數據處理芯片供用戶選擇。如果用戶自行設計電路,需遵循的電氣特性,并需要掌握EnDat接口的協議,保證嚴格遵循協議的時序要求和數據幀格式。而如果采用海德漢提供的數據處理芯片,則可以簡化設計,用戶只需配置FPGA的寄存器,按照芯片可接受的指令格式發送指令,就可獲得需要的數據。

        通過遵循RS 一485 (差分信號)標準的收發元件,在后續電子設備發出的同步時鐘激勵下,數據(位置值和參數)可以在編碼器和后續電子設備之間雙向傳輸。

        四 FPGA+軟件宏

        海德漢的合作伙伴MAZet公司針對Xilinx公司的Virtex和Spartan系列及Altera公司的Acex和Cyclone系列提供了EnDat協議的軟件宏,根據客戶需求,MAZet公司還可以提供定制軟核。該軟核實現了EnDat接口的所有功能,用戶可通過6位地址線和16位數據線與微控制器進行8位或16位的數據傳輸。下面是FPGA的模塊圖和電路設計。

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        圖4 FPGA模塊圖

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        圖5 編碼器和后續電路連接模塊圖五 結束語

        海德漢公司的EnDat接口在很多行業已得到廣泛的應用,現在它又被提升到嶄新高度。雙向EnDat 2.2接口的時鐘頻率現已提高到16 MHz,能滿足直接驅動這類高動態性能要求的應用,特別是電子工業的應用,時鐘頻率從8 MHz提高到16 MHz不僅將大大縮短讀取位置信息所需時間,還可以大幅縮短控制環的周期。同時簡單、經濟的系統設計為客戶提供了方便,強大的功能和通用性及具有前瞻的安全設計理念引導編碼控制技術不斷向前發展。(end)


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