基于ARM9的CMOS圖像采集系統的設計與實現

　邏輯結構圖的工作原理如下：
　(1)CLKOUT0為S3C2410A的輸出時鐘引腳，根據S3C2410A內部寄存器MisCCR中4~6位的不同設置可以輸出不同的時鐘，如系統時鐘FCLK、AHB(內部)總線時鐘HCLK和APB(外部)總線時鐘PCLK等。系統將其作為CMOS圖像傳感器的主時鐘輸入MCLK。
　(2)啟動信號START為S3C2410A的一個I/O，高電平有效，由于KAC9638的啟動信號OE是低電平有效，所以它們之間要連接一個非門。
　(3)VSYNC為傳感器的幀同步信號，輸出一幀有效圖像時該信號一直為高電平，用該信號連接S3C2410A的外部中斷XINT，使CPU能控制一幀圖像的開始和結束。
　(4)D[9：0]為圖像傳感器輸出的數據流，D[15：10]位用0填充，組成16位數據輸入到緩沖。緩沖的寫入允許信號是啟動信號START和幀有效信號VSYNC的邏輯與。在緩沖內兩個周期移位成32位數據。
　(5)緩沖寫入時鐘WRCLK由傳感器的像元輸出時鐘PCLK提高，一個周期寫入一個10位A/D值，所以一次輸出32位數據時，輸出時鐘周期是PCLK的二分頻。并將PCLK的二分頻作為S3C2410A外部DMA的請求信號XDREQ。
　(6)片選信號線nGCS4：作為32位緩沖的控制線，低電平有效。在進行數據采集時將DMA方式的源地址設置在BANK4范圍內，讀操作時即選中該緩沖。
　圖7是用Verilog語言編寫的程序仿真的圖像采集時序圖。

3.3 DMA方式采集圖像數據程序設計
　系統采集一幀圖像數據的流程圖如圖8所示。

　(1)啟動圖像采集：主控CPU從串口或其他通信口接收到采集命令后，通過START信號線通知CPLD采集信號，CPLD再通過硬件引腳OE啟動KAC9638采集圖像數據。
　(2)DMA初始化：包括DMA的源地址、目標地址、DMA次數等初始化。
　(3)開外中斷：當一幀數據采集完成后，通過外部中斷通知CPU。
　(4)DMA數據傳輸無需CPU干預，一幀圖像完成后產生中斷。
　(5)DMA中斷產生并且外部中斷產生才算是一幀圖像采集完成，然后交由主控CPU進行處理。若只有其中一個中斷產生，并且等待另一個中斷超時，則是在采集過程中丟失了數據，采集圖像失敗。
4 硬件調試
4.1 硬件調試環境
　在系統硬件調試中，使用集成開發環境配合JATG仿真器進行調試是目前采用最多的一種調試方式[7]。集成開發環境選用ARM公司的ADS1.2。JTAG仿真器也稱為JTAG調試器，是通過ARM芯片的JATG邊界掃描口進行調試的設備。屬于完全非插入式(即不使用片上資源)調試。
4.2 硬件調試步驟及結果
　(1)BootLoad系統引導測試
先使用英蓓特公司開發的Flash燒寫工具將BootLoad程序燒寫到Flash，若在PC超級終端上能正確接收目標板的串口返回的啟動信息，表明系統正常運行，可以用ADS下載程序到SDRAM進行調試。
　(2)圖像傳感器測試
?、買2C配置測試
　將ADS編譯好的bin文件下載到目標板的SDRAM，超級終端接收到返回的圖像傳感器ID正確，則表明I2C通信正常。通過I2C配置圖像大小為3(H)×5(V)，用示波器測量傳感器幀同步(vsync)、行同步(hsync)及像元時鐘(pclk)的關系。如圖9所示，11個像元時鐘(設定的每行3個像元加上每行開始的8個全黑像元)對應1個行同步時鐘，圖10顯示了幀同步信號及行同步信號的關系：5個行同步時鐘對應1個幀同步時鐘。測試結果表明S3C2410A可以正確配置圖像傳感器的工作方式。

　②圖像采集測試
　為方便檢驗采集到的圖像，將ARM采集到的圖像數據通過UART口發送到PC終端，再將數據組合成圖像顯示。接收到的數據如圖11所示。

　采用CMOS圖像傳感器、CPLD和ARM9的DMA結合完成圖像的采集是本系統的特點。該方法提高了圖像的采集速度，減少了CPU的開銷。CMOS圖像傳感器價格適中，外圍簡單，且集成I2C接口便于編程控制；CPLD將CMOS傳感器輸出數據移位成32位數據，可以使傳感器以更高的速度輸出；ARM9的DMA負責圖像采集，使得CPU可以解放出來處理其他任務。實驗測試結果證明，該圖像采集系統硬件平臺方案設計合理、可行。該系統在實際中可以應用于視頻圖像監控、圖像自動檢測、醫療及軍事檢測等場所，具有良好的應用前景。
參考文獻
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