用CPLD實現FIR數字濾波器的設計
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和“011”是由不同的h(n)之和構成，而對h(n)的選擇是由乘數x(n)的相同位的比特決定的。例如上圖x(n)的最低位為1001，則p1的值為h(1) + h(4)；其高位為1010，則p1的值為 h (1) + h(3)。因此利用Altera公司FLEX器件中的查找表（LUT）結構，預先將h(n)的各種組合存入查找表，則上例中的原需4次乘法 和3次加法的卷積運算轉化為1次加法。圖3顯示了用查找表實現該例的結構。 用查表法實現卷積運算時，有并行和串行兩種結構。圖3中為并行結構，其中兩個LUT是完全相同的。在并行結構中，LUT的數量根據x(n)的數據寬度決定。一位對應一個LUT，這樣速度達到最大，在FLEX10K的結構中提供了兩條專用數據通道，即進位鏈和級聯鏈，通過級聯鏈相鄰的LUT可以用來并行計算函數的各個部分。
利用FLEX10K芯片實現FIR數字濾波器
FELEX10K系列芯片具有查找表結構，利用其實現采用全局并行的FIR數字濾波器，也即將輸入x(n) 經過不同的延遲后同時進行處理。FIR數字濾波器的層次結構圖如圖4所示：
本文引用地址：http://www.104case.com/article/188815.htm
控制器模塊（contr）的作用是產生控制信號對延遲、并串轉換、抽頭系數、移位相加模塊進行控制，以使它們按一定的形式組合在一起實現濾波器功能。控制器模塊在接收到A/D轉換結束信號后，依次產生移位寄存器使能信號、并行到串行轉換的裝入信號、移位相加的裝入信號、加減控制信號和濾波結果輸出信號等各種控制信號，使上述各個模塊按照一定的時序進行操作，從而完成濾波功能。時延環節模塊（shift-reg）的作用為使A/D轉換后的數據通過不同的觸發器，進而產生不同的延遲。并/串轉換模塊（p-s-ff）的作用是將通過時延模塊產生的不同延遲分別同時轉換為查找表的串行地址，提供給抽頭系數模塊。抽頭系數模塊（sub-rom）將抽頭系數的各種組合固化在ROM中。它的地址輸入端接收并/串轉換模塊的串行輸出，然后查表得到卷積的中間數據.。移位相加模塊通過將中間數據移位相加而實現兩個數相乘的功能。
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