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        采樣保持電路中全差分運(yùn)算放大器的設(shè)計(jì)與仿真

        作者: 時(shí)間:2010-11-09 來(lái)源:網(wǎng)絡(luò) 收藏

          與套筒式結(jié)構(gòu)相比,折疊共源共柵結(jié)構(gòu)放大器輸出擺幅增大了一個(gè)過(guò)驅(qū)動(dòng)電壓,另外較大的共模輸入范圍是我們選擇折疊共源共柵結(jié)構(gòu)的主要原因。

          3 開(kāi)關(guān)電容共模反饋(CMFB)電路

          由于采用結(jié)構(gòu),而在高增益的中,輸出共模電平對(duì)器件的特性和適配相當(dāng)敏感,而且不能通過(guò)差模反饋來(lái)達(dá)到穩(wěn)定,因此設(shè)計(jì)時(shí)增加了共模反饋電路模塊,來(lái)穩(wěn)定輸出共模電平。共模反饋電路如圖2 所示。共模反饋電路與主運(yùn)放的連接如圖1 所示。


        圖 2 共模反饋電路

          該結(jié)構(gòu)與電阻檢測(cè)方式,運(yùn)用MOSFET 作為源級(jí)跟隨器和可變電阻的檢測(cè)技術(shù)相比有明顯優(yōu)點(diǎn)。其工作流程如下,時(shí)鐘信號(hào)在Φ1 相位時(shí),為C1 充電,確定C1 兩端的電壓,在Φ2 相位時(shí),將C1 與C2 并聯(lián),根據(jù)Vo1 和Vo2 平均值的大小確定輸出共模電平。例如,(Vo1+Vo2)/2>VREF,則輸出共模電平cmctl bias v > v ,從而使尾電流減小,最終導(dǎo)致輸出(Vo1+Vo2)/2 減小,連續(xù)幾個(gè)周期調(diào)整后,將使(Vo1+Vo2)/2≈Vref。從而達(dá)到控制輸出共模電平的目的。

          4 偏置電路

          如圖3 為放大器的偏置電路。MN1,MN2 及MN1,MN3 組成NMOS 電流鏡,2,3 支路將鏡像1 支路的電流,MP3,MP4 組成PMOS 電流鏡,這樣,4 支路的電流將鏡像自3 支路。MP2,MP1,MN4,MN5 采用二極管連接方式,以提供主放所需要的偏置,1 支路所用電流源,在電路設(shè)計(jì)中已替換成溝道長(zhǎng)度L 較大(可以提供高阻抗)的管,調(diào)整此PMOS 管的尺寸可以調(diào)整偏置電流,進(jìn)而控制運(yùn)放的增益,帶寬及擺率等特性。


        圖 3 的偏置電路

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