在FPGA內部資源中，RAM是較為常用的一種資源。
通常實例化RAM中，一種使用為BLOCK RAM 也就是塊RAM 。另外資源可以通過寄存器搭，也就是分布式RAM。前者一般用于提供較大的存儲空間，后者則提供小的存儲空間。
在實際應用過程中，一般使用的包括，單端口、雙端口RAM，ROM等形式等不同的形式。 實際應用中FIFO也是利用RAM和邏輯一起實現的。
對于一塊RAM中，其能夠例化的深度是有限的。例如cyclone4的RAM9k中可以例化的資源如下所示：
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FPGA RAM ROM
FIFO在FPGA設計中除了上篇所介紹的功能之外， 還有以下作為以下功能使用：
(1) 內存申請
在軟件設計中，使用malloc()和free()等函數可以用于內存的申請和釋放。特別是在有操作系統的環境下，可以保證系統的內存空間被動態的分配和使用，非常的方便。如果在FPGA內部實現此動態的內存分配和申請，相對來說較為復雜，例如某些需要外部數據存儲且需動態改變的應用需求下，需要對FPGA外部DDR(或SRAM等)的存儲空間，進行動態的分配和釋放。通過使用FIFO作為內存分配器，雖然比不上軟件
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FPGA FIFO SRAM
FIFO是FPGA內部一種常用的資源，可以通過FPGA廠家的的IP生成工具生成相應的FIFO。FIFO可分為同步FIFO和異步FIFO，其區別主要是，讀寫的時鐘是否為同一時鐘，如使用一個時鐘則為同步FIFO，讀寫時鐘分開則為異步FIFO。一般來說，較大的FIFO可以選擇使用內部BLOCK RAM資源，而小的FIFO可以使用寄存器資源例化使用。
一般來說，FIFO的主要信號包括：
實際使用中，可編程滿的信號(XILINX 的FIFO)較為常用，ALTERA的FIFO中，可以通過寫深度(即寫入
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FPGA FIFO RAM
“可穿戴”設備是指人體可穿戴的微型電子產品，通常與現有配飾(如手表)集成或者取而代之。在物聯網技術的支持下，該細分市場正迅猛發展，因此對于更小型化、更直觀的設備的需求也在快速提升。目前，智能手表、智能眼鏡以及體育與健身活動跟蹤器等體現出這一發展趨勢。除了消費類市場之外，醫療行業也對身體狀況與功能的監控設備有著更高的需求。
可穿戴設備中最重要的電子組件就是微控制器(MCU)。由于這些MCU不但需要尺寸小，而且還需要執行更多功能，因此，集成成為了另一大要素。我們將會在本文中探
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可穿戴設備 MCU PWM
在實際的應用中，雖然有源蜂鳴器控制簡單，缺陷是成本比較高，在潮濕的環境用久了，容易損壞。而無源蜂鳴器彌補了有源蜂鳴器缺點，但問題是無源蜂鳴器需要PWM驅動。在系統的設計中，微控制器的PWM資源往往是比較緊張的，同時使用PWM驅動也加大了軟件開發的難度。接下來筆者將引領大家學習如何設計一個無需PWM也能驅動無源蜂鳴器的低成本電路。
1.1 無源蜂鳴器常規驅動電路
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圖1 無源蜂鳴器常規驅動電路
如圖1所示，此圖為無源蜂鳴器的常規驅動電路。需要在輸入端輸入一定頻
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蜂鳴器 PWM 微控制器
在PWM和電子鎮流器當中，半橋電路發揮著重要的作用。半橋電路由兩個功率開關器件組成，它們以圖騰柱的形式連接在一起，并進行輸出，提供方波信號。本篇文章將為大家介紹半橋電路的工作原理，以及半橋電路當中應該注意的一些問題，希望能夠幫助電源新手們更快的理解半橋電路。
首先我們先來了解一下半橋電路的基本拓撲：
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半橋電路的基本拓撲電路圖
電容器C1和C2與開關管Q1、Q2組成橋，橋的對角線接變壓器T1的原邊繞組，故稱半橋變換器。如果此時C1=C2，那么當某一開關管導通
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半橋電路 PWM 電子鎮流器
在項目設計初期，基于硬件電源模塊的設計考慮，對FPGA設計中的功耗估計是必不可少的。筆者經歷過一個項目，整個系統的功耗達到了100w,而單片FPGA的功耗估計得到為20w左右，有點過高了，功耗過高則會造成發熱量增大，溫度高最常見的問題就是系統重啟，另外對FPGA內部的時序也不利，導致可靠性下降。其它硬件電路的功耗是固定的，只有FPGA的功耗有優化的余地，因此硬件團隊則極力要求筆者所在的FPGA團隊盡量多做些低功耗設計。筆者項目經歷尚淺，還是第一次正視功耗這碼事兒，由于項目時間比較緊，而且xilinx方
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FPGA 低功耗 RTL
摘要：網絡報文數據的記錄和分析在智能化變電站中尤為重要，通過對整個通信過程的記錄可以為事故分析及運行維護提供依據。本文提出了一種基于FPGA技術、結合相關通信協議的報文數據分析系統的設計方案，實現了報文數據分析系統的各功能子模塊，通過仿真運行驗證了系統良好的處理能力。
引言
隨著計算機技術、通信技術及網絡技術的迅速發展，基于這三種核心技術的自動化智能裝置在電網控制中的作用越來越突出。其中以交換式以太網和光纖光纜實現的網絡通信系統已經逐漸成為變電站的重要單元。
如何記錄、分析某個智能單
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FPGA 以太網 IEC61850 PHY CPU MAC 201411
摘要：隨著視頻壓縮技術的不斷發展，單路1080p@60Hz分辨率的視頻可以壓縮到幾兆進行傳輸，一個百兆網口可以傳輸多達10多路的IP視頻信號。目前的服務器單純依靠CPU進行軟解碼已經顯得非常吃力[1];匹配高性能的服務器或者配置多臺服務器卻有存在高成本的壓力。針對這些現狀，本文設計了一個基于TI的DaVinci?平臺的網絡視頻解碼系統。驗證結果顯示，采樣該網絡視頻解碼系統，可以使得單臺服務器增加上百路的IP視頻解碼，同時不影響服務器的其它性能，性能可靠且成本有很大優勢。
1 TI 8
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DaVinci IP視頻 CPU Linux FPGA 201411
1 緒言
1.1 太陽能智能晾衣架簡介
晾衣架作為每天使用的家居用品，如今已經成為許多家庭的生活必需品。作為消費者來說，選擇品牌關鍵是貨真價實。其結構、用料、做工等均是不可或缺的商品組成部分，質量和售后服務更是該行業生產商生存與發展的永恒構成自動晾衣架是升降晾衣架的另一種稱謂，早在2000年前出現的一種晾曬衣服的用具，現時有手搖的和遙控的兩大類，這種產品剛出來時晾桿是用不銹鋼圓管做的，款式單一，只是作為一種方便晾曬衣服的工具，但隨著時間的推移，生產晾衣架的廠家越來越多，競爭越來越大，廠家各
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太陽能 PWM EVK1100
采集數據的有效傳輸和存儲轉發技術的發展保證了數字圖像在現實中廣泛應用。如今，從多媒體通信領域的遠程教育、圖像監視到醫學上的遠程會診，都和數據的有效傳輸及存儲轉發技術息息相關。在國防工業領域，圖像數據的采集存儲和連續有效轉發也起著巨大的作用，航空遙感圖像和衛星遙感圖像的處理加工，電視制導中數據視頻圖像的傳輸，都離不開圖像傳輸存儲技術。本文設計的基于Flash的高速大容量固態數據存儲器，采用了基于LVDS的數據傳輸方式傳輸兩路高速圖像數據，實現圖像數據的高速實時存儲。不僅具有處理速度快、設計靈活性高等特點
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LVDS 數據存儲器 FPGA
項目背景及可行性分析
項目名稱、項目的主要內容及目前的進展情況
項目主要內容：聲音分離的研究在聲音通信、聲學目標檢測等方面都有著重要的理論和實用價值;聲源分離技術在機器聽覺、安保監控、軍事等領域具有特別的應用。目前，嘈雜背景下，單聲源定位與增強，已有所應用;但多聲源情景下的定位與分離，由于算法和硬件復雜，還很少走向應用。本項目通過構建麥克風陣列信號采集硬件，實現FPGA聲音分離算法，以完成兩個或兩個以上聲源的三維定位和分離，利用FPGA的并行性，以達到實時性的目標。項目難點在于，制作信號采
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FPGA NE5532 AD73360
7.1.3 虹膜外邊緣的確定
(1) 虹膜外邊緣的特征分析
由圖1中所示的虹膜圖像可以看出，虹膜外邊緣的主要特點是：較相對與虹膜內邊緣而言，邊緣處灰度變化不是特別明顯，有一小段漸變的區域。也就是說，虹膜內部灰度趨近于一致這個事實，在參考文獻[8]中，介紹的環量積分算子應該式是一種有效的方法。
即：
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(7-10)
(2) 采用環量積分算子實現虹膜外邊緣的檢測
如上分析，虹膜環量積分算子是檢測虹膜外邊緣的一種有效手段，為了克服虹膜紋理對環量線
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FPGA 虹膜識別 CMOS
項目信息
1.項目名稱：基于FPGA的混沌加密虹膜識別系統設計
2.應用領域：工業控制、科研、醫療、安檢
3.設計摘要：
基于虹膜的生物識別技術是一種最新的識別技術，通過一定的虹膜識別算法，可以達到十分優異的準確性。隨著虹膜識別技術的發展，它的應用領域越來越寬，不僅在高度機密場所應用，并逐步推廣到機場、銀行、金融、公安、出入境口岸、安全、網絡、電子商務等場合。在研究了虹膜識別算法，即預處理、特征提取和匹配的基礎上，我們設計了一種可便攜使用的基于FPGA的嵌入式虹膜識別系統。本系
關鍵字：
FPGA 虹膜識別 CMOS
1.引言
隨著工業技術的發展，在航空、軍事、機械制造領域等需要多個電機同時驅動一個或多個工作部件進行協調控制的場合越來越多。傳統的控制系統多采用單一電機實現單軸控制，電機的輸出轉矩有一定的限制，當傳動系統需要較大的驅動功率時，必須特制功率與之相匹配的驅動電機和驅動器，使得系統的成本上升，而且過大的輸出功率的電機受到制造工藝和電機性能的影響，大功率的驅動器的研制也會受到半導體功率器件的限制[1].電機在實時跟隨同一目標轉速的同時。還需要保持兩電機問的轉速同步，否則便會導致后面的機械傳動精度下降。針
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svpwm 電機控制 PWM
fpga-pwm介紹
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