- 系統概述
新能源發電成為21世紀解決能源危機的必經出路，光伏發電、風電、核電等新能源發電是目前新能源發電研究的幾大方向。這幾種新能源各有各的特點，我們選擇了最靠近我們的光伏發電作為研究出發點。
目前光伏發電并網技術的研究愈加深入成熟，而關于光伏發電技術的具體應用環節還是有著許多發揮余地。光伏發電的優點是清潔安全、分布相對較為均勻、可持續利用。同時光伏發電也存在自己的問題，其中一個很重要的問題是光伏發電需要做的是收集輻射到地表的太陽能，這個環節需要占用大量的空間，這個問題使光伏發電的應用有著
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FPGA 逆變器
- 隨著系統內電源數量的增多，為了確保其安全、經濟、持續和正常的工作，對電源軌進行監測和控制變得非常重要，特別是在使用微處理器時。確定電壓軌是否處于工作范圍內，以及該電壓相對于其它電壓軌是否按照正確的時序上電或斷電，這些對于系統執行的可靠性和安全性來說都是至關重要的。例如FPGA，在向組件提供5V I/O(輸入/輸出)電壓之前，必須先施加3.3V的核心電壓，并持續至少20ms，以避免組件上電時受到損壞。對于系統的可靠性來說，滿足這樣的時序要求就像要保證組件在規定的電源電壓和溫度范圍內工作一樣至關重要。
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FPGA DSP
- 要實現能夠將所有重要功能集成在單一器件的設計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產權的保護。如果一項設計功能的精髓能夠深植于單一芯片上，將會大大增加第三方取得這項設計的困難度。
單芯片系統對嵌入式系統設計師來說，往往會隨著其面對的不同的系統設計而各有不同。例如，在龐大的娛樂或通信消費產品市場中，SoC意味著一顆具有數百萬邏輯門的集成電路(IC)，其中包含許多大型定制邏輯模塊，并有將芯片的數字處
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FPGA SOC
- Mentor Graphics公司今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗證團隊，可將創建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上，從而顯著提高效率。這就意味著，驗證團隊可以將更多的時間花在 QVIP 上，以驗證他們的設計在功能上是否正確。
EZ-VIP 包由 QVIP 配置軟件、一個 VIP 調通服務包和一個全新的 EZ-VIP API 組成。其中，QVI
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Mentor Graphics FPGA
- 一、VGA的誘惑
首先，VGA的驅動，這事，一般的單片機是辦不到的;由于FPGA的速度，以及并行的優勢，加上可現場配置的優勢，VGA的配置，只有俺們FPGA可以勝任，也只有FPGA可以隨心所欲地配置(當然ARM也可以，應用比較高吧)。
初學者就是喜歡看炫的效果，往往會忍不住想玩。尤其玩FPGA的，沒玩VGA就感到跟單片機沒啥提升，因此VGA的驅動也不得不講。Bingo當年也是如此。擋不住VGA的誘惑，初學者問Bingo VGA問題的人也是灰常的多，也許一般教科書理論太強，實際應用不是很身后
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VGA FPGA
- Altera公司今天發布其Stratix® 10 FPGA和SoC體系結構和產品細節，這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現全面突破，勢必將云時代的網絡通信技術推向又一個巔峰。
Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構，由Intel® 14 nm三柵極工藝技術制造，內核性能是前一代FPGA的2倍。業界性能最好、密度最高、具有先進的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構
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Altera FPGA
- FPGA(Field-Programmable Gate Array)，即現場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發展的產物。它是作為專用集成電路(ASIC)領域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門電路數有限的缺點。FPGA的開發相對于傳統PC、單片機的開發有很大不同。FPGA以并行運算為主，以硬件描述語言來實現;相比于PC或單片機(無論是馮諾依曼結構還是哈佛結構)的順序操作有很大區別，也造成了FPGA開發入門較難。目前國內有專
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FPGA A/D
- 射頻識別(RFID)技術是一種非接觸式的自動識別技術，通過射頻信號自動識別目標對象并獲取相關信息。通常RFID系統主要由應用軟件、射頻卡以及讀卡器三部分構成[1]。相對于低頻段的RFID系統，工作在860 MHz～960 MHz的超高頻段(UHF)RFID系統有著讀取距離遠、閱讀速度快等優點，是目前國際上RFID技術發展的熱點[2]。讀卡器的設計是RFID系統設計中的關鍵部分，設計方案有很多種。FPGA[3]具有開發簡單、靜態可重復編程和動態在線編程的特點，已經成為當今應用最廣泛的可編程專用集成電路。
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FPGA 讀卡器
- 通常來講，“一個好漢三個幫”，一個完整的嵌入式系統中由單獨一個FPGA使用的情況較少。通常由多個器件組合完成，例如由一個FPGA+CPU來構成。通常為一個FPGA+ARM，ARM負責軟件配置管理，界面輸入外設操作等操作，FPGA負責大數據量運算，可以看做CPU的專用協處理器來使用，也常會用于擴展外部接口。常用的有ARM+FPGA，DSP+FPGA，或者網絡處理器+FPGA等種種架構形式，這些架構形式構成整個高速嵌入式設備的處理形態。
不得不說的是，隨著技術的進步，現在CP
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ARM FPGA
- 引言
脈寬調制(PWM)是從微控制器或FPGA等數字器件產生模擬電壓的一種常用方法。大多數微控制器都具有內置的專用PWM產生外設，而且其僅需幾行RTL代碼即可從FPGA產生一個PWM信號。如果模擬信號的性能要求不是太嚴格，那么這就是一種簡單和實用的方法，因為它只需要一個輸出引腳，而且與具有一個SPI或I2C接口的數模轉換器(DAC)相比，其代碼開銷是非常低。圖1示出了一款典型應用，其采用一個經濾波的數字輸出引腳來產生一個模擬電壓。
該方案的諸多不足之處您不必深究就能發現。理想情況下，一個1
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PWM FPGA
- 1引言
DDS同DSP(數字信號處理)一樣，是一項關鍵的數字化技術。DDS是直接數字式頻率合成器(DirectDigitalSynthesizer)的英文縮寫。與傳統的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉換時間等優點，廣泛使用在電信與電子儀器領域，是實現設備全數字化的一個關鍵技術。在各行各業的測試應用中，信號源扮演著極為重要的作用。但信號源具有許多不同的類型，不同類型的信號源在功能和特性上各不相同，分別適用于許多不同的應用。目前，最常見的信號源類型包括任意波形發生器，函數發
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FPGA DDS
- 光纖陀螺是激光陀螺的一種，是慣性技術和光電子技術緊密結合的產物。它利用Sagnac干涉效應，用光纖構成環形光路，并檢測出隨光纖環的轉動而產生的兩路超輻射光束之間的相位差，由此計算出光纖環旋轉的角速度。光纖陀螺儀主要由兩個部分組成。伺服于表頭的調制解調電路根據輸進的電信號，經過相應的變換后形成反饋信號送至表頭的相位調制器中。在實際的應用過程中，相應的調制解調電路應該根據溫度、振動等情況做出相應的改變，才能最大限度地保證陀螺的精度要求。本文設計了一種基于FPGA的測試系統，模擬光纖陀螺儀的表頭，并檢測調制
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FPGA 陀螺儀
- 引言
Altera公司的Nios II處理器是可編程邏輯器件的軟核處理器。NiosII軟核處理器和存儲器、I/O接口等外設可嵌入到FPGA中，組成一個可編程單芯片系統(SOPC)，大大降低了系統的成本、體積和功耗。適合網絡、電信、數據通信、嵌入式和消費市場等各種嵌入式應用場合。
本文提出一個基于Nios II處理器結構的系統用于實現機器人實時運動檢測跟蹤，使用線性卡爾曼濾波器算法來快速完成運動估計及進一步分析和校正，算法中的乘除利用MATLAB/DSP Builder生成的模塊作為Nios
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Nios II FPGA
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