Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件公司的一款電路設計與仿真軟件，它包括ISIS，ARES等軟件模塊，其中ARES模塊主要用來完成PCB設計，而ISIS模塊主要用來完成電路原理圖的設計與仿真。Proteus的軟件仿真基于VSM技術，與其他仿真軟件的不同也是最大的優勢在于它能夠仿真大量的單片機芯片，主要包括MCS-51系列，PIC系列，AVR系列，ARM系列等等，軟件配備了大最的單片機外圍電路與單片機配合，如鍵盤、LED、LCD、ADC、DAC、存
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Proteus DSP
AMD宣布其嵌入式 Radeon HD 7850 GPU 協助Analogic公司旗下 BK Ultrasound 醫用超音波產品的超音波系統 bk3000 發揮卓越應用效能。新款 BK Ultrasound 醫用超音波 bk3000 搭載AMD嵌入式 Radeon 繪圖技術，可望使成像及系統效能到全新境界。
AMD嵌入式 Radeon HD 7850 GPU 采用AMD屢屢獲獎的次世代繪圖核心(GCN)架構為基礎，帶動各種嵌入式應用在視覺與平行處理功能提升。除了超音波外， GPGPU 的其他應
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AMD嵌 Radeon GPU FPGA
致力于在電源、安全、可靠和性能方面提供差異化半導體技術方案的領先供應商美高森美公司(Microsemi Corporation) 宣布完成9項全新的美國國家標準與技術研究所(National Institute of Standards and Technology, NIST)加密算法驗證程序(CAVP)認證。
美高森美SmartFusion®2 SoC FPGA和 IGLOO®2 FPGA通過的認證項目包括NIST “Suite B”中的AES加密/解
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美高森美 NIST FPGA
接觸式圖像傳感器CIS( CONTACT Image SENSOR )是繼CCD之后于20世紀90年代研究和開發的一種新型光電耦合器件[1]。它將光電傳感陣列、LED光源陣列、柱狀透鏡陣列、移位寄存器和模擬開關等集成在一個條狀方形盒內，其工作原理與CCD較為相似，但與CCD相比，CIS具有體積小、價格低、結構簡單、安裝方便等優點，目前在傳真機、掃描儀及條碼*器等領域可完全取代CCD圖像傳感器。
本文介紹一種基于復雜可編程邏輯器件CPLD(Complex Programmable LOGIC DE
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CPLD DSP 圖像傳感器
0 引言
DSP是基于可編程超大規模集成電路和計算機技術發展起來的一門重要技術，DSP芯片的快速數據采集與處理功能以及片上集成的各種功能模塊為DSP應用于各種場合提供了極大的方便。而CMOS圖像傳感器與CCD相比，由于CMOS圖像傳感器能將時序處理電路和圖像信號的前端放大與數字化部分集成 于一個芯片內，因而其發展一直受到業界的高度重視。現在，隨著技術與工藝的發展，CMOS圖像傳感器不僅在噪聲上得到了有效改善，而且分辨率也得到了明顯提高。CMOS圖像傳感器將以其低廉的價格、實用的圖像質量、高集成
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OV6630 DSP
汽車在給人們生活帶來便利的同時也帶來了交通事故。其中超速行駛是造成交通事故的重要隱患之一。據研究表明，目前針對車輛超速行駛情況的道路抓拍系統中所使用的圖像傳感器大多為小面陣器件，普遍為100萬～200萬像素,從而導致抓拍圖像的像素比較低、能夠同時抓拍的車道數較少等等問題。面對這一系列問題，大面陣的圖像傳感器便逐漸成了人們關注的熱點。在設計過程中，分析了具有500萬像素的CMOS圖像傳感器MT9P401的工作模式,選用QuartusⅡ做為開發工具，使用Verilog HDL語言對驅動電路設計方案進行了硬
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FPGA 圖像傳感器
當人們考慮有兩個圖像傳感器的應用時，首先很可能想到的是一個三維攝相機。不過，也有許多設計可以通過使用來自兩個圖像傳感器的數據進行改善;一個例子是汽車司機錄像機(CDR)的黑盒子，這通常是安裝在后視鏡附近，擁有兩個攝像機(圖1)。一個攝像機朝向擋風玻璃，而另一個攝像機指向司機。在本地的存儲器芯片中存儲攝像機的視頻，如果有意外事故或疑問，可以進行檢索。
基于FPGA的雙圖像傳感器設計方案.pdf
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FPGA 圖像傳感器
就算你代碼再怎么牛逼，硬件描述語言再怎么熟練，沒有認知FPGA的工作原理，一切都是浮云。因此，在真正開始實戰演練之前，Bingo將首先介紹FPGA最小工作配置要求，以及一些基本的外設，并通過DIY CPLD/FPGA系統板案例的分析講解，用淺顯易懂的語言，讓初學者深刻認識CPLD/FPGA的工作原理，能夠有一個更深刻的軟硬件思維。
一、Altium Designer 09 winter 軟件介紹
Layout的軟件有很多，包括Altium Designer、P
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FPGA CPLD DIY
上次看了一下關于乘法器的Verilog代碼，有幾個地方一直很迷惑，相信很多初學者看這段代碼一定跟我當初一樣，看得一頭霧水，在網上也有一些網友提問，說這段代碼不好理解，今天小墨同學就和大家一起來看一下這段代碼，我會親自在草稿紙上演算，盡量把過程寫的詳細些，讓更多的人了解乘法器的設計思路。
下面是一段16位乘法器的代碼，大家可以先瀏覽一下，之后我再做詳細解釋
module mux16(
clk,rst_n,
start,ain,bin,yout,done
);
inpu
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FPGA Verilog 時序邏輯
Nios Ⅱ嵌入式處理器是ALTERA公司推出的采用哈佛結構、具有32位指令集的第二代片上可編程的軟核處理器, 其最大優勢和特點是模塊化的硬件結構, 以及由此帶來的靈活性和可裁減性。本文基于Nios Ⅱ介紹20款經典設計方案，供大家參考。
基于NiosⅡ的U盤安全控制器設計
本文針對U盤的安全隱患，分析目前較為常見的解決方法，利用SoPC技術，設計實現了一款基于NiosⅡ處理器的U盤安全控制器。該控制器位于PC機和U盤之間，通過對U盤進行扇區級的加解密操作，將普通U盤升級為安全U盤，保證U
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ALTERA FPGA SoPC
引言
以往的直流電機調速系統通常采用單片機或DSP進行控制，而單片機需要使用大量的外圍電路，且系統的可升級性差，如更換控制器，往往要對整個軟硬件進行重新設計，可重用性不高。而采用DSP作為主要控制器，如果碰到處理多任務系統時，一片DSP不能勝任，這時就需要再擴展一片DSP或者FPGA芯片來輔助控制，從而實行雙芯片控制模式。但這樣做，既增加了兩個處理器之間同步和通信的負擔，又使系統實時性變壞，延長系統開發時間。基于以上此類問題，本文提出了采用Altera公司推出的NiosⅡ軟核來控制直流電機調速系
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PID NiosⅡ FPGA
引言
為了解決傳統DSP所面臨的速度低、硬件結構不可重構、開發升級周期長和不可移植等問題，本文應用Altera公司推出的NiosII嵌入式軟核處理器，提出了一種具有常規DSP的NiosII系統功能SOPC解決方案。由于可編程的NiosII核含有許多可配置的接口模塊，用戶可根據設計要求，利用QuartusII和SOPC Builder對NiosII及其外圍系統進行構建。用戶還可通過Matlab和DSP Builder，或直接用VHDL等硬件描述語言，為NiosII嵌入式處理器設計各類硬件模塊，并以
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DSP NiosII SOPC
系統以FPGA為核心,通過對正弦信號進行濾波、放大整形后得到標準的方波,由FPGA對其頻率、周期及相位差進行測量。頻率、周期測量采用等精度測量法,其具有精度高的特點;相位差測量采用鑒相器分辨出相位差后測量其高電平所占比例測量。摒棄傳統的FPGA+單片機方案,利用SOPC Builder在FPGA上構建Nios Ⅱ處理器對測量的數據進行數據處理及顯示,實現了頻率、周期、相位差測量的片上系統(SOPC),提高了系統的穩定性、降低了布線難度。
基于Nios_處理器的多功能計數器系統設計.pdf
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NiosⅡ 多功能計數器 FPGA
自2005年9月LXI總線推出以來，已經顯示出其組建測試系統的眾多優點。基于LXI總線組建測試系統具有易于使用、靈活性高、模塊化和可擴縮性、實現更快的系統吞吐率、可分布式應用、長壽命、低成本、通過IEEE1588時鐘同步、機架空間小、合成儀器等諸多優點。
1553B總線的全名為“時分制指令/響應式多路傳輸數據總線”，國內多型戰斗機、軍艦等武器平臺都采用其作為傳輸總線。因此研制基于LXI總線的1553B通訊模塊，不僅能滿足多型武器裝備對1553B總線的測試需求，也對LXI總
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NiosⅡ 1553B FPGA
1. 晶振的作用--晶振的基本概念
晶振是電路中常用用的時鐘元件，全稱是叫晶體震蕩器，它是利用具有壓電效應的石英晶體片制成的。其作用在于產生原始的時鐘頻率，這個頻率經過頻率發生器的放大或縮小后就成了電腦中各種不同的總線頻率。由于石英諧振器具有體積小、重量輕、可靠性高、頻率穩定度高等優點，被應用于家用電器和通信設備中。石英諧振器因具有極高的頻率穩定性，故主要用在要求頻率十分穩定的振蕩電路中作諧振元件。
2. 晶振的作用--晶振的符號表示
晶振在結構上分為兩只腳的晶振和三只腳的晶振，它們在電
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晶振 DSP datasheet 晶振的作用
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