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        cpld/fpga 文章 最新資訊

        DIY小發(fā)明:打造你自己的流媒體播放器,解決方案、硬件框圖

        • 主要內(nèi)容為利用Xilinx的Virtex-2 Pro FPGA 上豐富的邏輯資源來實現(xiàn)一個自定義的模塊,該模塊能作為流媒體播放過程中的一個功能部件。
        • 關(guān)鍵字: DIY  流媒體播放器  Virtex-2Pro  FPGA  

        基于FPGA的IIR數(shù)字濾波器的設(shè)計方案

        • 用FPGA實現(xiàn)數(shù)字濾波器具有實時性強、靈活性高、處理速度快以及小批量生產(chǎn)成本低等優(yōu)點,所以得到了較為廣泛的應用。本文以巴特沃思數(shù)字帶通濾波器為例,較為詳細地介紹了其設(shè)計和實現(xiàn)方法。給定巴特沃茲數(shù)字帶通濾波器的抽樣頻率為500Hz,上、下邊帶截止頻率分別為150Hz和30Hz。
        • 關(guān)鍵字: IIR數(shù)字濾波器  雙線性變換法  FPGA  matlab  

        可編程邏輯器件與單片機在雙控制器中的設(shè)計

        • 可編程邏輯器件的D觸發(fā)器資源非常有限,而且可編程邏輯器件在控制時序方面不如單片機那樣方便,很多不熟悉的應用者往往感到應用起來非常的困難。利用可編程邏輯器件和單片機構(gòu)成的雙向通信控制器克服了兩者的缺點,且把二者的長處最大限度地發(fā)揮出來。
        • 關(guān)鍵字: 可編程邏輯器件  雙控制器  AT89C51  CPLD  單片機  

        基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(圖)

        • 數(shù)據(jù)采集系統(tǒng)是通過采樣電路將輸入的模擬信號轉(zhuǎn)換成離散信號,并送入CPU、MCU或DSP進行處理。現(xiàn)在流行的基于PCI總線設(shè)計的采集卡是數(shù)據(jù)采集系統(tǒng)的主流,其優(yōu)點是可以利用PCI總線的研究成果快速的開發(fā)系統(tǒng)軟件,整體運行速度快,能夠?qū)崿F(xiàn)實時采集實時處理。但在一些工業(yè)測控現(xiàn)場檢測大型設(shè)備時,從現(xiàn)場到機房有一定的距離,模擬信號傳到安裝在PC內(nèi)的PCI數(shù)據(jù)采集卡會有不同程度的衰減,且易受工業(yè)環(huán)境的干擾。而單純用由微控制器(MCU)為核心的數(shù)據(jù)采集系統(tǒng)時,把數(shù)據(jù)采集器置于被監(jiān)測的設(shè)備處,雖然可以避免模擬信號的衰減和
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        FPGA設(shè)計頻率計算方法

        • 我們的設(shè)計需要多大容量的芯片?我們的設(shè)計能跑多快?這是經(jīng)常困擾工程師的兩個問題。對于前一個問題,我們可能還能先以一個比較大的芯片實現(xiàn)原型,待原型完成再選用大小合適的芯片實現(xiàn)。對于后者,我們需要一個比較精確的預估。
        • 關(guān)鍵字: 頻率計算  D觸發(fā)器  FPGA  Tlogic  

        基于FPGA平臺構(gòu)建汽車輔助駕駛系統(tǒng)算法(圖)

        • 汽車輔助駕駛(DA)系統(tǒng)工程師通常使用 PC 模型來創(chuàng)建復雜的處理算法,以便實現(xiàn)高度可靠的自適應巡航控制、車道偏離警告及行人檢測等功能。開發(fā)人員高度重視PC算法模型,因為這種模型使他們能夠嘗試使用并快速評估不同的處理算法。不過,說到底,還是需要一款設(shè)計合理的電子硬件解決方案,來實現(xiàn)經(jīng)濟有效的大規(guī)模生產(chǎn)與部署。
        • 關(guān)鍵字: 汽車輔助駕駛  算法  FPGA  

        14nm的FPGA需要什么樣的電源管理IC?

        • 現(xiàn)在的FPGA不僅僅是一個邏輯器件,它現(xiàn)在更加像一個平臺,在一個FPGA中常常會包含有數(shù)字信號處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么,這樣的FPGA需要什么樣的電源管理IC來與之配合呢?
        • 關(guān)鍵字: 電源管理IC  14nm  FPGA  Enpirion  CycloneVSoC  

        分析FPGA的基本結(jié)構(gòu)

        • FPGA由6部分組成,分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。
        • 關(guān)鍵字: 硬核  輸入/輸出  FPGA  邏輯單元  RAM  

        如何通過RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計

        • EDA 公司和 FPGA 廠商不斷開發(fā)新的工具和方法,推進繁瑣任務的自動化,幫助設(shè)計團隊集中精力做好創(chuàng)造性工作。下面我們就來看看 FPGA 工具流程的演進發(fā)展,了解一下現(xiàn)代 FPGA 團隊是如何利用 RTL分析、約束生成和綜合導向來減少設(shè)計迭代的。
        • 關(guān)鍵字: RTL  SDC  綜合向?qū)?/a>  FPGA  

        基于FPGA的視頻信號發(fā)生器設(shè)計與應用研究

        • 本文介紹了一種基于FPGA的新型視頻信號發(fā)生器,它可以滿足多種被測系統(tǒng)對輸入視頻信號制式的要求。該系統(tǒng)利用USB總線與上位機進行通信,同時解決了系統(tǒng)供電的問題。在FPGA內(nèi)部,通過軟件編程的方法生成視頻信號的圖像和時序控制信號,并送入視頻D /A模塊。
        • 關(guān)鍵字: 視頻信號發(fā)生器  視頻采集卡  FPGA  

        用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計中的錯誤

        • Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計人員完成上述工作。這些工具的特性使得設(shè)計人員能快速隔離錯誤,有效縮短運行時間,并減少開發(fā)板啟動所需的迭代次數(shù)。
        • 關(guān)鍵字: 智能調(diào)試  SynplifyPremier  FPGA  SynplifyProFPGA  

        信號去直流方法

        • 本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計的去直流模塊,其基本原理采用一階濾波器,如圖1所示,通過一個一階RC電路,在V0端可等效一個低通濾波器,得到直流分量。
        • 關(guān)鍵字: 信號去直流  DSP48E1  FPGA  一階濾波器  

        用于實現(xiàn)嵌入式安全的開源硬件

        • 想像一下你正在排隊等待參加一個重要活動。門票是通過網(wǎng)上購買的,存儲在你的智能手機中。你需要將手機放到某個指定區(qū)域上,建立起NFC連接,門票隨之得到確認,大門開啟允許你進入。好消息是,所有這一切都是在匿名情況下發(fā)生的。
        • 關(guān)鍵字: 嵌入式安全  開源硬件  零知識證明  ZKPK  FPGA  

        FPGA與多核CPU如何改變嵌入式設(shè)計

        • 隨著嵌入式器件在過去數(shù)十年來的爆炸性成長,使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新,但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計方法卻少有進步,并逐漸變成一種障礙。有鑒于新標準與協(xié)議的快速發(fā)展,以及對產(chǎn)品上市壓力的日益增加,嵌入式系統(tǒng)設(shè)計也即將發(fā)生顛覆性的典范改變。隨著硬件技術(shù)及軟件工具的進步在加速成長,由整合所帶來的挑戰(zhàn)也
        • 關(guān)鍵字: 多核CPU  嵌入式設(shè)計  FPGA  
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