- 提出了以DSP為控制核心，采用USB通信設計的飛機防滑剎車測試系統。分析了飛機防滑剎車測試系統的組成，并介紹了測試系統主要硬件電路設計和系統上下位機軟件設計。
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剎車 測試系統 設計 防滑 飛機 USB 接口 DSP 基于
- 目前，處理器性能的主要衡量指標是時鐘頻率。絕大多數的集成電路 (IC) 設計都基于同步架構，而同步架構都采用全球一致的時鐘。這種架構非常普及，許多人認為它也是數字電路設計的唯一途徑。然而，有一種截然不同的設計技術即將走上前臺：異步設計。
這一新技術的主要推動力來自硅技術的發展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優點，被看作是滿足這一需要的途徑。
異步技術由于諸多原因曾經備受冷落，其中最重要的是缺乏標準化的
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功耗 高性能 設計 核心 DSP 異步
- 在最近的機器人比賽和電子設計競賽中，較多參賽題目要求機器人沿場地內白色或黑色指引線行進。一些研究人員提出了基于尋線的機器人設計策略，主要是關注指引線的檢測，但對于機器人的整體設計未做說明。本文在總結此類賽事的基礎上，提出了一種將DSP(Digital Signal Processor)和CPLD(Complex Programmable Logic Device)作為核心處理器，采用模糊控制策略處理來自檢測指引線傳感器信號的機器人行走機構的通用性設計方法。
1 車體機械設計
由于機器人比賽
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DSP 模糊控制 機器人 傳感器 單片機
- 三維圖像信息處理一直是圖像視頻處理領域的熱點和難點，目前國內外成熟的三維信息處理系統不多，已有的系統主要依賴高性能通用PC完成圖像采集、預處理、重建、構型等囊括底層和高層的處理工作。三維圖像處理數據量特別大、運算復雜，單純依靠通用PC很難達到實時性要求，不能滿足現行高速三維圖像處理應用。
本系統中，采用FPGA實現底層的信號預處理算法，其處理數據量很大，處理速度高，但算法結構相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數據量較少、算法結構復雜，可采用運算速度快、尋址方式靈活、通信機制強大的
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FPGA DSP 三維圖像信息處理 EVIP PCI
- 數字濾波器在數字信號處理的各種應用中發揮著十分重要的作用，他是通過對采樣數據信號進行數學運算處理來達到頻域濾波的目的。數字濾波器既可以是有限長單脈沖響應(FIR)濾波器也可以是無限長單脈沖響應(IIR)濾波器。在維納濾波器理論發明的早期，人們使用IIR濾波器，但現在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發軟件的DSP開發工具。在DSP
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濾波器 設計 FIR Builder DSP 基于
- 這一新技術的主要推動力來自硅技術的發展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優點，被看作是滿足這一需要的途徑。
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功耗 高性能 設計 核心 DSP 異步
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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8位微處理器 DSP 數字 低通濾波器
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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數字信號處理 DSP
- 本文通過研究提出了一種多處理器實時開發環境的設計思想，它可以支持多種型號處理器的同時開發，使系統級開發變得簡單易行。
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環境 設計 開發 實時 DSP 處理器 基于
- 介紹了DSP應用系統的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設計方法，并給出了接口電路在設計時須注意的幾個問題。
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DSP 應用系統 電路設計 硬件接口
- 視頻壓縮編碼標準H.264／AVC是由ISO／IEC和ITU-T組成的聯合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術，如4×4整數變換、空域內的幀內預測，多參考幀與多種大小塊的幀間預測技術等，標準一經推出，就以其高效的壓縮性能和友好的網絡特性受到業界的廣泛推崇。特別是在2004年7月JVT組織做了重要的保真度范圍擴展的補充后，更加擴大了標準的應用范圍，但同時巨大的運算量卻成為其廣泛應用的瓶頸。考慮到H.264協議實現的復雜度，本文的思路是：一方面提高硬件處理速度和能力，采
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DSP 編碼算法 視頻壓縮編碼 編碼器 ARM CPU
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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DSP 合眾達
- 仿真是所有系統成功開發的基礎。通過在不同條件、參數值和輸入情況下對系統進行高級行為仿真，工程師可以迅速找到、分離并糾正系統的設計問題。因為在這一階段，比較容易區分設計問題和編程問題。通過在系統級工作，設計人員可以確定這一階段的問題是來自設計缺陷，而不是編程問題。此外，在信號處理系統設計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設計中出現錯誤到發現錯誤并分離錯誤的時間。
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真的 重要性 系統 DSP FPGA 設計 采用
- 采用自頂向下的流程設計了一款32位DSP的cache。該cache采用兩級結構，第一級采用哈佛結構，第二級采用普林斯頓結構。本文詳細論述了該cache的結構設計及采用的算法。
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結構設計 cache 兩級 DSP 32位
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